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參數資料
| 型號： | MC68HC12BC32VFU8 |
| 廠商： | MOTOROLA INC |
| 元件分類： | 微控制器/微處理器 |
| 英文描述： | 16-BIT, MROM, 8 MHz, MICROCONTROLLER, PQFP80 |
| 封裝： | QFP-80 |
| 文件頁數： | 171/362頁 |
| 文件大?。?/td> | 4604K |
| 代理商： | MC68HC12BC32VFU8 |
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Byte Data Link Communications (BDLC)
Data Sheet
M68HC12B Family — Rev. 9.0
252
Byte Data Link Communications (BDLC)
MOTOROLA
NBFS — Normalization Bit Format Select Bit
This bit controls the format of the normalization bit (NB). (See Figure 15-14.)
SAE J1850 encourages using an active long (logic 0) for in-frame responses
containing cyclical redundancy check (CRC) and an active short (logic 1) for
in-frame responses without CRC.
0 = NB that is received or transmitted is a 1 when the response part of an
in-frame response (IFR) ends with a CRC byte. NB that is received or
transmitted is a 0 when the response part of an in-frame response (IFR)
does not end with a CRC byte.
1 = NB that is received or transmitted is a 0 when the response part of an
in-frame response (IFR) ends with a CRC byte. NB that is received or
transmitted is a 1 when the response part of an in-frame response (IFR)
does not end with a CRC byte.
TEOD — Transmit End of Data Bit
This bit is set by the programmer to indicate the end of a message is being sent
by the BDLC. It appends an 8-bit CRC after completing transmission of the
current byte. This bit also is used to end an in-frame response (IFR). If the
transmit shadow register is full when TEOD is set, the CRC byte is transmitted
after the current byte in the Tx shift register and the byte in the Tx shadow
register have been transmitted. (See 15.8.3 Rx and Tx Shadow Registers for
a description of the transmit shadow register.) Once TEOD is set, the transmit
data register empty flag (TDRE) in the BDLC state vector register (BSVR) is
cleared to allow lower priority interrupts to occur. (See 15.9.3 BDLC State
1 = Transmit end-of-data (EOD) symbol
0 = TEOD bit is cleared automatically at the rising edge of the first CRC bit
that is sent or if an error is detected. When TEOD is used to end an IFR
transmission, TEOD is cleared when the BDLC receives back a valid
EOD symbol or an error condition occurs.
TSIFR, TMIFR1, TMIFR0 — Transmit In-Frame Response Bits
These bits control the type of in-frame response being sent. Only one of these
bits should be set at a time. If more than one are set, the priority encoding logic
forces the bits to a known value as shown in Table 15-3. For example, if 011 is
written to TSIFR, TMIFR1, and TMIFR0, then internally they are encoded as
010. However, when these bits are read back, they read 011.
Table 15-3. Transmit In-Frame Response Bit Encoding
Write/Read(1)
1. Shaded cells indicate bits which do not affect internal interpretation. These bits read
back as written.
Internal Interpretation
TSIFR
TMIFR1
TMIFR0
TSIFR
TMIFR1
TMIFR0
00
000
0
1
10
0
01
0
00
100
1
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PDF描述 |
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參數描述 |
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| MC68HC16Z1CAG20 | 制造商:Freescale Semiconductor 功能描述:Microcontroller |
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