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參數(shù)資料
| 型號： | MC68HC11PH8CPV3 |
| 廠商： | ABILIS SYSTEMS |
| 元件分類： | 微控制器/微處理器 |
| 英文描述： | 8-BIT, MROM, 3 MHz, MICROCONTROLLER, PQFP112 |
| 封裝： | TQFP-112 |
| 文件頁數(shù)： | 81/264頁 |
| 文件大小： | 1469K |
| 代理商： | MC68HC11PH8CPV3 |
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MC68HC11PH8
MOTOROLA
8-37
TIMING SYSTEM
8
The modulus register can be written to at any time without affecting the down-counter; care must
be taken by the programmer to ensure that a new value is written to the modulus register before
the down-counter reaches $00, unless the previous value is to be reloaded. A read of the modulus
register with the timer running will access a latched value of the down-counter. This latch
guarantees a stable value during the read and is updated with each timer clock. To determine the
value in the modulus register itself (for timers B and C), the timer must be stopped by the
appropriate clock selection (see Section 8.3.2), then a one must be written to the preset bit in the
control register. The down-counter now contains the modulus register value.
Note:
Because it is used to clock the COP watchdog in applications using PLL clock
generation, timer A cannot be stopped (therefore, the value in modulus register A
cannot be determined).
Note:
The timer preset bits only have an effect if the timer is stopped under hardware control
(timers B and C only).
The recommended procedure for conguring timers B and C is as follows:
1) Stop the timer by writing %000 to the relevant clock select control bits.
2) Set the modulus register by writing the required value to the timer data register.
3) Write a one to the timer preset bit.
4) Select the desired clock source to start the counter decrementing.
8.3.2
Clock rate selection
A number of clock rates can be selected in software for each of the three modulus timers. The
selection is controlled by bits 0-2 in the timer control register, as shown in the tables below.
Timer A may be used as a prescaler for timers B and C (see Figure 8-7). Similarly timer B may be
used as a prescaler for timer C, and vice versa.
Warning: Selecting EXTALi as a clock source when the PLL function is not used, i.e. when the
bus frequency is EXTALi/4, could lead to read or write errors in the timer registers.
Table 8-6 Modulus timers clock sources
CSA[2:0]
Timer A clock source
CSB[2:0] Timer B clock source
CSC[2:0] Timer C clock source
0 0 0
EXTALi/8
0 0 0
Stopped
0 0 0
Stopped
0 0 1
EXTALi
0 0 1
EXTALi
0 0 1
EXTALi
0 1 0
EXTALi/4
0 1 0
EXTALi/4
0 1 0
EXTALi /4
0 1 1
EXTALi/8
0 1 1
EXTALi/8
0 1 1
EXTALi /8
1 0 0
EXTALi/8
1 0 0
Timer A underow
1 0 0
Timer A underow
1 0 1
EXTALi/8
1 0 1
Timer C underow
1 0 1
Timer B underow
1 1 0
EXTALi/8
1 1 0
Rising edge PH7
1 1 0
Rising edge PH6
1 1 1
EXTALi/8
1 1 1
Stopped
1 1 1
Stopped
TPG
169
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