參數(shù)資料
型號： MC68HC08JL8MSP
廠商： FREESCALE SEMICONDUCTOR INC
元件分類： 微控制器/微處理器
英文描述： 8-BIT, MROM, 8 MHz, MICROCONTROLLER, PDIP32
封裝： SDIP-32
文件頁數(shù)： 88/212頁
文件大?。?/td> 1525K
代理商： MC68HC08JL8MSP
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Low Voltage Inhibit (LVI)
MC68HC908JL8/JK8 MC68HC08JL8/JK8 MC68HC908KL8 Data Sheet, Rev. 3.1
178
Freescale Semiconductor
15.4 LVI Control Register (CONFIG2/CONFIG1)
The LVI module is controlled by three bits in the configuration registers, CONFIG1 and CONFIG2.
LVID — Low Voltage Inhibit Disable Bit
LVID disables the LVI module. Reset clears LVID.
1 = Low voltage inhibit disabled
0 = Low voltage inhibit enabled
LVIT1, LVIT0 — LVI Trip Voltage Selection Bits
These two bits determine at which level of VDD the LVI module will come into action. LVIT1 and LVIT0
are cleared by a power-on reset only.
15.5 Low-Power Modes
The STOP and WAIT instructions put the MCU in low-power-consumption standby modes.
15.5.1 Wait Mode
The LVI module, when enabled, will continue to operate in wait mode.
15.5.2 Stop Mode
The LVI module, when enabled, will continue to operate in stop mode.
Address:
$001E
Bit 7
654321
Bit 0
Read:
IRQPUD
R
LVIT1
LVIT0
R
STOP_
ICLKDIS
Write:
Reset:
000
Cleared by POR only
000
Figure 15-2. Configuration Register 2 (CONFIG2)
Address:
$001F
Bit 7
654321
Bit 0
Read:
COPRS
R
LVID
R
SSREC
STOP
COPD
Write:
Reset:
00000000
Figure 15-3. Configuration Register 1 (CONFIG1)
Table 15-1. Trip Voltage Selection
LVIT1
LVIT0
Trip Voltage(1)
Comments
00
VLVR3 (2.49V)
For VDD=3V operation
01
VLVR3 (2.49V)
For VDD=3V operation
10
VLVR5 (4.25V)
For VDD=5V operation
11
Reserved
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PDF描述
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