參數(shù)資料
型號(hào)： MC68HC08GZ32CFAE
廠(chǎng)商： FREESCALE SEMICONDUCTOR INC
元件分類(lèi)： 微控制器/微處理器
英文描述： 8-BIT, MROM, 8 MHz, MICROCONTROLLER, PQFP48
封裝： 7 X 7 MM, 1.40 MM HEIGHT, 0.50 MM PITCH, LEAD FREE, PLASTIC, MS-026BBC, LQFP-48
文件頁(yè)數(shù)： 203/320頁(yè)
文件大?。?/td> 4400K
代理商： MC68HC08GZ32CFAE
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Break Module (BRK)
MC68HC08GZ32 Data Sheet, Rev. 3
Freescale Semiconductor
281
BRKA — Break Active Bit
This read/write status and control bit is set when a break address match occurs. Writing a 1 to BRKA
generates a break interrupt. Clear BRKA by writing a 0 to it before exiting the break routine. Reset
clears the BRKA bit.
1 = Break address match
0 = No break address match
20.2.2.2 Break Address Registers
The break address registers (BRKH and BRKL) contain the high and low bytes of the desired breakpoint
address. Reset clears the break address registers.
20.2.2.3 Break Status Register
The break status register (BSR) contains a flag to indicate that a break caused an exit from wait mode.
This register is only used in emulation mode.
SBSW — SIM Break Stop/Wait
SBSW can be read within the break state SWI routine. The user can modify the return address on the
stack by subtracting one from it.
1 = Wait mode was exited by break interrupt
0 = Wait mode was not exited by break interrupt
Address: $FE09
Bit 7
654321
Bit 0
Read:
Bit 15
Bit 14
Bit 13
Bit 12
Bit 11
Bit 10
Bit 9
Bit 8
Write:
Reset:
00000000
Figure 20-5. Break Address Register High (BRKH)
Address: $FE0A
Bit 7
654321
Bit 0
Read:
Bit 7
Bit 6
Bit 5
Bit 4
Bit 3
Bit 2
Bit 1
Bit 0
Write:
Reset:
00000000
Figure 20-6. Break Address Register Low (BRKL)
Address: $FE00
Bit 7
654321
Bit 0
Read:
RRRRRR
SBSW
R
Write:
Note(1)
Reset:
0
R
= Reserved
1. Writing a 0 clears SBSW.
Figure 20-7. Break Status Register (BSR)
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PDF描述
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