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參數(shù)資料
| 型號： | MC68HC08GP32VB |
| 廠商： | FREESCALE SEMICONDUCTOR INC |
| 元件分類： | 微控制器/微處理器 |
| 英文描述： | 8-BIT, MROM, 8.2 MHz, MICROCONTROLLER, PDIP42 |
| 封裝： | PLASTIC, SDIP-42 |
| 文件頁數(shù)： | 241/282頁 |
| 文件大小： | 1871K |
| 代理商： | MC68HC08GP32VB |
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MC68HC908GP32 MC68HC08GP32 Data Sheet, Rev. 7
Freescale Semiconductor
61
Chapter 6
Break Module (BRK)
6.1 Introduction
This section describes the break module. The break module can generate a break interrupt that stops
normal program flow at a defined address to enter a background program.
6.2 Features
Features of the break module include:
Accessible input/output (I/O) registers during the break interrupt
CPU-generated break interrupts
Software-generated break interrupts
COP disabling during break interrupts
6.3 Functional Description
When the internal address bus matches the value written in the break address registers, the break module
issues a breakpoint signal to the CPU. The CPU then loads the instruction register with a software
interrupt instruction (SWI) after completion of the current CPU instruction. The program counter vectors
to $FFFC and $FFFD ($FEFC and $FEFD in monitor mode).
The following events can cause a break interrupt to occur:
A CPU-generated address (the address in the program counter) matches the contents of the break
address registers.
Software writes a logic 1 to the BRKA bit in the break status and control register.
When a CPU-generated address matches the contents of the break address registers, the break interrupt
begins after the CPU completes its current instruction. A return-from-interrupt instruction (RTI) in the
break routine ends the break interrupt and returns the MCU to normal operation. Figure 6-1 shows the
structure of the break module.
6.3.1 Flag Protection During Break Interrupts
The BCFE bit in the SIM break flag control register (SBFCR) enables software to clear status bits during
the break state.
6.3.2 CPU During Break Interrupts
The CPU starts a break interrupt by:
Loading the instruction register with the SWI instruction
Loading the program counter with $FFFC and $FFFD ($FEFC and $FEFD in monitor mode)
The break interrupt begins after completion of the CPU instruction in progress. If the break address
register match occurs on the last cycle of a CPU instruction, the break interrupt begins immediately.
相關PDF資料 |
PDF描述 |
|---|---|
| MC68HC908GP32CB | 8-BIT, FLASH, 8.2 MHz, MICROCONTROLLER, PDIP42 |
| MC68HC08GR32AMFAE | 8-BIT, MROM, 8 MHz, MICROCONTROLLER, PQFP48 |
| MC68HC08GR32AMFA | 8-BIT, MROM, 8 MHz, MICROCONTROLLER, PQFP48 |
| MC68HC08GR32AVFJ | 8-BIT, MROM, 8 MHz, MICROCONTROLLER, PQFP32 |
| MC68HC08GR32AVFU | 8-BIT, MROM, 8 MHz, MICROCONTROLLER, PQFP64 |
相關代理商/技術參數(shù) |
參數(shù)描述 |
|---|---|
| MC68HC08GP32VFB | 制造商:MOTOROLA 制造商全稱:Motorola, Inc 功能描述:M68HC08 Family of 8-bit microcontroller units (MCUs) |
| MC68HC08GR16A | 制造商:FREESCALE 制造商全稱:Freescale Semiconductor, Inc 功能描述:Microcontrollers |
| MC68HC08GR32A | 制造商:FREESCALE 制造商全稱:Freescale Semiconductor, Inc 功能描述:Microcontrollers |
| MC68HC08GR32ACFA | 制造商:FREESCALE 制造商全稱:Freescale Semiconductor, Inc 功能描述:Microcontrollers |
| MC68HC08GR32ACFJ | 制造商:FREESCALE 制造商全稱:Freescale Semiconductor, Inc 功能描述:Microcontrollers |
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