參數(shù)資料
型號(hào)： MC68HC08AZ32AMFU
廠商： FREESCALE SEMICONDUCTOR INC
元件分類： 微控制器/微處理器
英文描述： 8-BIT, MROM, 8.4 MHz, MICROCONTROLLER, PQFP64
封裝： QFP-64
文件頁數(shù)： 10/312頁
文件大?。?/td> 2091K
代理商： MC68HC08AZ32AMFU
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LVI Status Register (LVISR)
MC68HC08AZ32A Data Sheet, Rev. 2
Freescale Semiconductor
107
9.4 LVI Status Register (LVISR)
The LVI status register flags VDD voltages below the LVITRIPF level.
LVIOUT — LVI Output Bit
This read-only flag becomes set when VDD falls below the LVITRIPF voltage for 32–40 CGMXCLK
cycles. (See Table 9-1). Reset clears the LVIOUT bit.
9.5 LVI Interrupts
The LVI module does not generate interrupt requests.
9.6 Low-Power Modes
The WAIT instruction puts the MCU in low-power consumption standby mode.
9.6.1 Wait Mode
With the LVIPWR bit in the MORA register programmed to 1, the LVI module is active after a WAIT
instruction.
With the LVIRST bit in the MORA register programmed to 1, the LVI module can generate a reset and
bring the MCU out of wait mode.
9.6.2 Stop Mode
With LVISTOP = 1 and LVIPWR = 1 in the MORA register, the LVI module will be active after a STOP
instruction. Because CPU clocks are disabled during stop mode, the LVI trip must bypass the digital filter
to generate a reset and bring the MCU out of stop.
Address: $FE0F
Bit 7
654321
Bit 0
Read:
LVIOUT
0000000
Write:
Reset:
00000000
= Unimplemented
Figure 9-3. LVI Status Register (LVISR)
Table 9-1. LVIOUT Bit Indication
VDD
LVIOUT
at level:
for number of CGMXCLK cycles:
VDD > LVITRIPR
Any
0
VDD < LVITRIPF
< 32 CGMXCLK cycles
0
VDD < LVITRIPF
between 32 and 40 CGMXCLK cycles
0 or 1
VDD < LVITRIPF
> 40 CGMXCLK cycles
1
LVITRIPF < VDD < LVITRIPR
Any
Previous value
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PDF描述
MC68HC08AZ32AVFU 8-BIT, MROM, 8.4 MHz, MICROCONTROLLER, PQFP64
MC68HC08AZ48AMFU 8-BIT, MROM, 8.4 MHz, MICROCONTROLLER, PQFP64
MC68HC08AZ60AMFU 8-BIT, MROM, 8.4 MHz, MICROCONTROLLER, PQFP64
MC68HC08AZ48AVFU 8-BIT, MROM, 8.4 MHz, MICROCONTROLLER, PQFP64
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MC68HC08AZ48 制造商:MOTOROLA 制造商全稱:Motorola, Inc 功能描述:Advance Information
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