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參數(shù)資料
| 型號： | MC68HC05X4CDW |
| 廠商： | MOTOROLA INC |
| 元件分類： | 微控制器/微處理器 |
| 英文描述： | HCMOS Microcontroller Unit |
| 中文描述： | 8-BIT, MROM, 2.2 MHz, MICROCONTROLLER, PDSO28 |
| 封裝： | PLASTIC, SOIC-28 |
| 文件頁數(shù)： | 82/156頁 |
| 文件大小： | 926K |
| 代理商： | MC68HC05X4CDW |
第1頁第2頁第3頁第4頁第5頁第6頁第7頁第8頁第9頁第10頁第11頁第12頁第13頁第14頁第15頁第16頁第17頁第18頁第19頁第20頁第21頁第22頁第23頁第24頁第25頁第26頁第27頁第28頁第29頁第30頁第31頁第32頁第33頁第34頁第35頁第36頁第37頁第38頁第39頁第40頁第41頁第42頁第43頁第44頁第45頁第46頁第47頁第48頁第49頁第50頁第51頁第52頁第53頁第54頁第55頁第56頁第57頁第58頁第59頁第60頁第61頁第62頁第63頁第64頁第65頁第66頁第67頁第68頁第69頁第70頁第71頁第72頁第73頁第74頁第75頁第76頁第77頁第78頁第79頁第80頁第81頁當前第82頁第83頁第84頁第85頁第86頁第87頁第88頁第89頁第90頁第91頁第92頁第93頁第94頁第95頁第96頁第97頁第98頁第99頁第100頁第101頁第102頁第103頁第104頁第105頁第106頁第107頁第108頁第109頁第110頁第111頁第112頁第113頁第114頁第115頁第116頁第117頁第118頁第119頁第120頁第121頁第122頁第123頁第124頁第125頁第126頁第127頁第128頁第129頁第130頁第131頁第132頁第133頁第134頁第135頁第136頁第137頁第138頁第139頁第140頁第141頁第142頁第143頁第144頁第145頁第146頁第147頁第148頁第149頁第150頁第151頁第152頁第153頁第154頁第155頁第156頁
Motorola CAN
MC68HC05X4
82
Motorola CAN
MOTOROLA
MCAN status
register (CSTAT)
This is a read only register; only the MCAN can change its contents.
BS — Bus status
This bit is set (off-bus) by the MCAN when the transmit error counter
reaches 256. The MCAN will then set RR and will remain off-bus until
the CPU clears RR again. At this point the MCAN will wait for 128
successive occurrences of a sequence of 11 recessive bits before
clearing BS and resetting the read and write error counters. While
off-bus the MCAN does not take part in bus activities.
1 = Off-bus – The MCAN is not participating in bus activities.
0 = On-bus – The MCAN is operating normally.
ES — Error status
1 = Error – Either the read or the write error counter has reached
the CPU warning limit of 96.
0 = Neither of the error counters has reached 96.
TS — Transmit status
1 = Transmit – The MCAN has started to transmit a message.
0 = Idle – If the receive status bit is also clear then the MCAN is
idle; otherwise it is in receive mode.
RS — Receive status
1 = Receive – The MCAN entered receive mode from idle, or by
losing arbitration during transmission.
0 = Idle – If the transmit status bit is also clear then the MCAN is
idle; otherwise it is in transmit mode.
NOTE:
RS will not be set during a bus failure with a permanent dominant bus
level.
Address:
$0022
Bit 7
6
5
4
3
2
1
Bit 0
BS
ES
TS
RS
TCS
TBA
DO
RBS
External Reset:
0
0
0
0
1
1
0
0
Reset: with RR bit set
u
u
0
0
1
1
0
0
Figure 6. MCAN Status Register (CSTAT)
14-mcan
F
Freescale Semiconductor, Inc.
For More Information On This Product,
Go to: www.freescale.com
n
.
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PDF描述 |
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