參數(shù)資料
型號: MC68HC05PV8AYDW
廠商: FREESCALE SEMICONDUCTOR INC
元件分類: 微控制器/微處理器
英文描述: 8-BIT, MROM, 4.2 MHz, MICROCONTROLLER, PDSO28
封裝: SOIC-28
文件頁數(shù): 194/196頁
文件大?。?/td> 4967K
代理商: MC68HC05PV8AYDW
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Input/Output Ports
Port A
MC68HC(8)05PV8/A — Rev. 1.9
Technical Data
Input/Output Ports
NO
NDI
S
CLO
S
URE
AG
REEMENT
REQ
U
IRED
7.4.4 Port A Configuration Register
VRHEN – Enable A/D High Reference Channel
Those bits connect the PA7 pin with the A/D high reference channel.
1 = A/D high reference channel connected to external VREFH.
0 = A/D high reference channel connected to internal voltage
supply.
PUHEN – PA4–7 Pull-Up Resistor Enable Higher Nibble
This bit disables/enables the pull-up resistors of the PA4–7 pins.
1 = PA4–7 pull-up resistors disabled
0 = PA4–7 pull-up resistors enabled
EDGEH – PA4–7 Interrupt Edge Higher Nibble
This bit selects the trigger edges of the interrupt lines PA4–7.
1 = Rising edge sensitive
0 = Falling edge sensitive
PAHIE – PA4–7 Interrupt Enable Higher Nibble
This bit disables/enables the PA4–7 pins as an interrupt group.
1 = PA4–7 interrupt enabled
0 = PA4–7 interrupt disabled
PULEN – PA0–3 Pull-Up Resistor Enable Lower Nibble
This bits disables/enables the pull-up resistors of the PA0–3 pins.
1 = PA0–3 pull-up resistors disabled
0 = PA0–3 pull-up resistors enabled
EDGEL – PA0–3 Interrupt Edge Lower Nibble
This bit selects the trigger edges of the interrupt lines PA0–3.
1 = Rising edge sensitive
0 = Falling edge sensitive
$0020
Bit 7
654321
Bit 0
Read:
VRHEN
PUHEN
EDGEH
PAHIE
PULEN
EDGEL
PALIE
VRLEN
Write:
Reset:
00000000
Figure 7-2 Port A Configuration Register (PACFG)
Freescale
Semiconductor,
I
Freescale Semiconductor, Inc.
For More Information On This Product,
Go to: www.freescale.com
nc.
..
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PDF描述
MC68HC05RC16P 8-BIT, MROM, 2.1 MHz, MICROCONTROLLER, PDIP28
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