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參數(shù)資料
| 型號： | MC68HC05K1DWR2 |
| 廠商： | MOTOROLA INC |
| 元件分類： | 微控制器/微處理器 |
| 英文描述： | 8-BIT, MROM, 2 MHz, MICROCONTROLLER, PDSO16 |
| 封裝： | SOIC-16 |
| 文件頁數(shù)： | 123/154頁 |
| 文件大?。?/td> | 1544K |
| 代理商： | MC68HC05K1DWR2 |
第1頁第2頁第3頁第4頁第5頁第6頁第7頁第8頁第9頁第10頁第11頁第12頁第13頁第14頁第15頁第16頁第17頁第18頁第19頁第20頁第21頁第22頁第23頁第24頁第25頁第26頁第27頁第28頁第29頁第30頁第31頁第32頁第33頁第34頁第35頁第36頁第37頁第38頁第39頁第40頁第41頁第42頁第43頁第44頁第45頁第46頁第47頁第48頁第49頁第50頁第51頁第52頁第53頁第54頁第55頁第56頁第57頁第58頁第59頁第60頁第61頁第62頁第63頁第64頁第65頁第66頁第67頁第68頁第69頁第70頁第71頁第72頁第73頁第74頁第75頁第76頁第77頁第78頁第79頁第80頁第81頁第82頁第83頁第84頁第85頁第86頁第87頁第88頁第89頁第90頁第91頁第92頁第93頁第94頁第95頁第96頁第97頁第98頁第99頁第100頁第101頁第102頁第103頁第104頁第105頁第106頁第107頁第108頁第109頁第110頁第111頁第112頁第113頁第114頁第115頁第116頁第117頁第118頁第119頁第120頁第121頁第122頁當前第123頁第124頁第125頁第126頁第127頁第128頁第129頁第130頁第131頁第132頁第133頁第134頁第135頁第136頁第137頁第138頁第139頁第140頁第141頁第142頁第143頁第144頁第145頁第146頁第147頁第148頁第149頁第150頁第151頁第152頁第153頁第154頁
Technical Data
MC68HC05K0 MC68HC05K1 — Rev. 2.0
70
Parallel Input/Output (I/O)
MOTOROLA
Technical Data
When a port A pin is programmed as an output, reading the port bit
actually reads the value of the data latch and not the voltage on the pin
itself. When a port A pin is programmed as an input, reading the port bit
reads the voltage level on the pin. The data latch can always be written,
regardless of the state of its DDR bit. Table 7-1 summarizes the
operations of the port A pins.
7.4 Port B
Port B is a 2-bit, general-purpose, bidirectional I/O port with these
features:
Programmable pulldown devices (mask option)
Oscillator output for 3-pin resistor-capacitor (RC) oscillator mask
option
7.4.1 Port B Data Register
The port B data register (PORTB), shown in Figure 7-5, contains a bit
for each of the port B pins. When a port B pin is programmed to be an
output, the state of its data register bit determines the state of the output
pin. When a port B pin is programmed to be an input, reading the port B
Table 7-1. Port A Pin Functions
Pulldown
Mask
Option
Control Bits
I/O Pin Mode
Accesses
to PDRA
Accesses
to DDRA
Accesses
to PORTA
PDIAx
DDRAx
Read
Write
Read/Write
Read
Write
No
X
0
Input, hi-z
U
PDIA7–PDIA0
DDRA7–DDRA0
Pin
PA0–PA7
No
X
1
Output
U
PDIA7–PDIA0
DDRA7–DDRA0
PA0–PA7
Yes
0
Input,
pulldown on
U
PDIA7–PDIA0
DDRA7–DDRA0
Pin
PA0–PA7
Yes
0
1
Output
U
PDIA7–PDIA0
DDRA7–DDRA0
PA0–PA7
Yes
1
0
Input, hi-z
U
PDIA7–PDIA0
DDRA7–DDRA0
Pin
PA0–PA7
Yes
1
Output
U
PDIA7–PDIA0
DDRA7–DDRA0
PA0–PA7
X = Don’t care
U = Undefined
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PDF描述 |
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