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參數資料
| 型號： | MC68HC001EI12 |
| 廠商： | Freescale Semiconductor |
| 文件頁數： | 165/189頁 |
| 文件大?。?/td> | 0K |
| 描述： | IC MPU 16BIT 12MHZ 68-PLCC |
| 標準包裝： | 18 |
| 系列： | M680x0 |
| 處理器類型： | M680x0 32-位 |
| 速度： | 12MHz |
| 電壓： | 3.3V，5V |
| 安裝類型： | 表面貼裝 |
| 封裝/外殼： | 68-LCC（J 形引線） |
| 供應商設備封裝： | 68-PLCC（25x25） |
| 包裝： | 管件 |
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MOTOROLA
M68000 8-/16-/32-BIT MICROPROCESSORS USER'S MANUAL
5- 31
Table 5-1.
DTACK, BERR, and HALT Assertion Results
Case
No.
Control
Signal
Asserted on
Rising Edge
of State
MC68000/MC68HC000/001
EC000/MC68008 Results
MC68010 Results
N
N+2
1
DTACK
BERR
HALT
A
NA
S
NA
X
Normal cycle terminate and continue.
2
DTACK
BERR
HALT
A
NA
A/S
S
NA
S
Normal cycle terminate and halt.
Continue when HALT negated.
Normal cycle terminate and halt.
Continue when HALT negated.
3
DTACK
BERR
HALT
X
A
NA
X
S
NA
Terminate and take bus error trap.
4
DTACK
BERR
HALT
A
NA
S
A
NA
Normal cycle terminate and continue.
Terminate and take bus error trap.
5
DTACK
BERR
HALT
X
A
A/S
X
S
Terminate and retry when HALT
removed.
Terminate and retry when HALT
removed.
6
DTACK
BERR
HALT
A
NA
S
A
Normal cycle terminate and continue.
Terminate and retry when HALT
removed.
LEGEND:
N — The number of the current even bus state (e.g., S4, S6, etc.)
A — Signal asserted in this bus state
NA
— Signal not asserted in this bus state
X — Don't care
S — Signal asserted in preceding bus state and remains asserted in this state
NOTE: All operations are subject to relevant setup and hold times.
The negation of BERR and HALT under several conditions is shown in Table 5-6. (DTACK
is assumed to be negated normally in all cases; for reliable operation, both DTACK and
BERR should be negated when address strobe is negated).
EXAMPLE A:
A system uses a watchdog timer to terminate accesses to unused address space. The
timer asserts BERR after timeout (case 3).
EXAMPLE B:
A system uses error detection on random-access memory (RAM) contents. The system
designer may:
1. Delay DTACK until the data is verified. If data is invalid, return BERR and HALT
simultaneously to retry the error cycle (case 5).
2. Delay DTACK until the data is verified. If data is invalid, return BERR at the same
time as DTACK (case 3).
3. For an MC68010, return DTACK before data verification. If data is invalid, assert
BERR and HALT to retry the error cycle (case 6).
F
re
e
sc
a
le
S
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ic
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n
d
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c
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I
Freescale Semiconductor, Inc.
For More Information On This Product,
Go to: www.freescale.com
n
c
..
.
相關PDF資料 |
PDF描述 |
|---|---|
| MC68HC001EI10 | IC MPU 16BIT 10MHZ 68-PLCC |
| GMC50DTEH | CONN EDGECARD 100POS .100 EYELET |
| AMM22DREF | CONN EDGECARD 44POS .156 EYELET |
| FMC40DREN-S93 | CONN EDGECARD 80POS .100 EYELET |
| FMC40DREH-S93 | CONN EDGECARD 80POS .100 EYELET |
相關代理商/技術參數 |
參數描述 |
|---|---|
| MC68HC001EI16 | 功能描述:微處理器 - MPU 16-BIT MPU RoHS:否 制造商:Atmel 處理器系列:SAMA5D31 核心:ARM Cortex A5 數據總線寬度:32 bit 最大時鐘頻率:536 MHz 程序存儲器大小:32 KB 數據 RAM 大小:128 KB 接口類型:CAN, Ethernet, LIN, SPI,TWI, UART, USB 工作電源電壓:1.8 V to 3.3 V 最大工作溫度:+ 85 C 安裝風格:SMD/SMT 封裝 / 箱體:FBGA-324 |
| MC68HC001EI8 | 功能描述:微處理器 - MPU 16-BIT MPU RoHS:否 制造商:Atmel 處理器系列:SAMA5D31 核心:ARM Cortex A5 數據總線寬度:32 bit 最大時鐘頻率:536 MHz 程序存儲器大小:32 KB 數據 RAM 大小:128 KB 接口類型:CAN, Ethernet, LIN, SPI,TWI, UART, USB 工作電源電壓:1.8 V to 3.3 V 最大工作溫度:+ 85 C 安裝風格:SMD/SMT 封裝 / 箱體:FBGA-324 |
| MC68HC001FN10 | 制造商:Rochester Electronics LLC 功能描述:16-BIT MPU - Bulk |
| MC68HC001FN12 | 制造商:Rochester Electronics LLC 功能描述:- Bulk |
| MC68HC001FN16 | 制造商:Rochester Electronics LLC 功能描述:16-BIT MPU - Bulk |
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