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參數(shù)資料
| 型號(hào)： | MC68307FG16 |
| 廠商： | MOTOROLA INC |
| 元件分類： | 微控制器/微處理器 |
| 英文描述： | 16-BIT, 16.67 MHz, MICROCONTROLLER, PQFP100 |
| 封裝： | PLASTIC, QFP-100 |
| 文件頁(yè)數(shù)： | 215/264頁(yè) |
| 文件大?。?/td> | 949K |
| 代理商： | MC68307FG16 |
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Bus Operation
3-16
MC68307 USER’S MANUAL
MOTOROLA
three-wire bus arbitration and Figure 3-15 and Figure 3-17 show two-wire bus arbitration.
BGACK must be pulled high for two-wire bus arbitration.
The timing diagram in Figure 3-16 shows that the bus request is negated at the time that an
acknowledge is asserted. This type of operation applies to a system consisting of a proces-
sor and one other device capable of becoming bus master. In systems having several
devices that can be bus masters, bus request lines from these devices can be wire-ORed
at the processor, and more than one bus request signal could occur.
The bus grant signal is negated a few clock cycles after the assertion of the bus grant
acknowledge signal. However, if bus requests are pending, the processor reasserts bus
grant for another request a few clock cycles after bus grant (for the previous request) is
negated. In response to this additional assertion of bus grant, external arbitration circuitry
selects the next bus master before the current bus master has completed the bus activity.
The timing diagram in Figure 3-17 also applies to a system consisting of a processor and
one other device capable of becoming bus master. Since the two-wire bus arbitration
scheme does not use a bus grant acknowledge signal, the external master must continue to
assert BR until it has completed its bus activity. The processor negates BG when BR is
negated.
Figure 3-15. Two-Wire Bus Arbitration Cycle Flowchart
PROCESSOR
REQUESTING DEVICE
REQUEST THE BUS
REARBITRATE OR RESUME
ASSERT BUS GRANT (BG)
OPERATE AS BUS MASTER
GRANT BUS ARBITRATION
ASSERT BUS REQUEST (BR)
1) EXTERNAL ARBITRATION
DETERMINES NEXT BUS MASTER
2) NEXT BUS MASTER WAITS FOR
CURRENT CYCLE TO COMPLETE
ACKNOWLEDGE RELEASE OF
NEGATE BUS GRANT (BG)
RELEASE BUS MASTERSHIP
NEGATE BUS REQUEST (BR)
PROCESSOR OPERATION
BUS MASTERSHIP
相關(guān)PDF資料 |
PDF描述 |
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