- 您現(xiàn)在的位置：買賣IC網(wǎng) > PDF目錄4007 > MC68020EH33E (Freescale Semiconductor)IC MPU 32BIT 33MHZ 132-PQFP PDF資料下載
參數(shù)資料
| 型號： | MC68020EH33E |
| 廠商： | Freescale Semiconductor |
| 文件頁數(shù)： | 254/306頁 |
| 文件大小： | 0K |
| 描述： | IC MPU 32BIT 33MHZ 132-PQFP |
| 標準包裝： | 36 |
| 系列： | M680x0 |
| 處理器類型： | M680x0 32-位 |
| 速度： | 33MHz |
| 電壓： | 5V |
| 安裝類型： | 表面貼裝 |
| 封裝/外殼： | 132-BQFP 緩沖式 |
| 供應(yīng)商設(shè)備封裝： | 132-PQFP（24.13x24.13） |
| 包裝： | 托盤 |
第1頁第2頁第3頁第4頁第5頁第6頁第7頁第8頁第9頁第10頁第11頁第12頁第13頁第14頁第15頁第16頁第17頁第18頁第19頁第20頁第21頁第22頁第23頁第24頁第25頁第26頁第27頁第28頁第29頁第30頁第31頁第32頁第33頁第34頁第35頁第36頁第37頁第38頁第39頁第40頁第41頁第42頁第43頁第44頁第45頁第46頁第47頁第48頁第49頁第50頁第51頁第52頁第53頁第54頁第55頁第56頁第57頁第58頁第59頁第60頁第61頁第62頁第63頁第64頁第65頁第66頁第67頁第68頁第69頁第70頁第71頁第72頁第73頁第74頁第75頁第76頁第77頁第78頁第79頁第80頁第81頁第82頁第83頁第84頁第85頁第86頁第87頁第88頁第89頁第90頁第91頁第92頁第93頁第94頁第95頁第96頁第97頁第98頁第99頁第100頁第101頁第102頁第103頁第104頁第105頁第106頁第107頁第108頁第109頁第110頁第111頁第112頁第113頁第114頁第115頁第116頁第117頁第118頁第119頁第120頁第121頁第122頁第123頁第124頁第125頁第126頁第127頁第128頁第129頁第130頁第131頁第132頁第133頁第134頁第135頁第136頁第137頁第138頁第139頁第140頁第141頁第142頁第143頁第144頁第145頁第146頁第147頁第148頁第149頁第150頁第151頁第152頁第153頁第154頁第155頁第156頁第157頁第158頁第159頁第160頁第161頁第162頁第163頁第164頁第165頁第166頁第167頁第168頁第169頁第170頁第171頁第172頁第173頁第174頁第175頁第176頁第177頁第178頁第179頁第180頁第181頁第182頁第183頁第184頁第185頁第186頁第187頁第188頁第189頁第190頁第191頁第192頁第193頁第194頁第195頁第196頁第197頁第198頁第199頁第200頁第201頁第202頁第203頁第204頁第205頁第206頁第207頁第208頁第209頁第210頁第211頁第212頁第213頁第214頁第215頁第216頁第217頁第218頁第219頁第220頁第221頁第222頁第223頁第224頁第225頁第226頁第227頁第228頁第229頁第230頁第231頁第232頁第233頁第234頁第235頁第236頁第237頁第238頁第239頁第240頁第241頁第242頁第243頁第244頁第245頁第246頁第247頁第248頁第249頁第250頁第251頁第252頁第253頁當(dāng)前第254頁第255頁第256頁第257頁第258頁第259頁第260頁第261頁第262頁第263頁第264頁第265頁第266頁第267頁第268頁第269頁第270頁第271頁第272頁第273頁第274頁第275頁第276頁第277頁第278頁第279頁第280頁第281頁第282頁第283頁第284頁第285頁第286頁第287頁第288頁第289頁第290頁第291頁第292頁第293頁第294頁第295頁第296頁第297頁第298頁第299頁第300頁第301頁第302頁第303頁第304頁第305頁第306頁
5- 4
M68020 USER’S MANUAL
MOTOROLA
a write cycle, all 32 bits of the data bus are driven, regardless of the port width or operand
size. The processor places the data on the data bus one-half clock cycle after AS is
asserted in a write cycle.
5.1.5 Data Strobe
DS is a timing signal that applies to the data bus. For a read cycle, the processor asserts
DS to signal the external device to place data on the bus. DS is asserted at the same time
as AS during a read cycle. For a write cycle, DS notifies the external device that the data
to be written is valid. The processor asserts DS one full clock cycle after the assertion of
AS during a write cycle.
5.1.6 Data Buffer Enable
The MC68020 DBEN signal is used to enable external data buffers while data is present
on the data bus. During a read operation, DBEN is asserted one clock cycle after the
beginning of the bus cycle and is negated as DS is negated. In a write operation, DBEN is
asserted at the time AS is asserted and is held active for the duration of the cycle. Note
that DBEN is implemented in the MC68020 and is not implemented in the MC68EC020.
5.1.7 Bus Cycle Termination Signals
During bus cycles, external devices assert DSACK1/DSACK0 as part of the bus protocol.
During a read cycle, DSACK1/DSACK0 assertion signals the processor to terminate the
bus cycle and to latch the data. During a write cycle, the assertion of DSACK1/DSACK0
indicates that the external device has successfully stored the data and that the cycle may
terminate. DSACK1/DSACK0 also indicate to the processor the size of the port for the bus
cycle just completed, as shown in Table 5-1. Refer to 5.3.1 Read Cycle for timing
relationships of DSACK1/DSACK0.
The BERR signal is also a bus cycle termination indicator and can be used in the absence
of DSACK1/DSACK0 to indicate a bus error condition. It can also be asserted in
conjunction with DSACK1/DSACK0 to indicate a bus error condition, provided it meets the
appropriate timing described in this section and in Section 10 Electrical Characteristics.
Additionally, the BERR and HALT signals can be asserted together to indicate a retry
termination. Again, the BERR and HALT signals can be simultaneously asserted in lieu of,
or in conjunction with, the DSACK1/DSACK0 signals.
Finally, the AVEC signal can be used to terminate interrupt acknowledge cycles, indicating
that the MC68020/EC020 should generate a vector number to locate an interrupt handler
routine. AVEC is ignored during all other bus cycles.
F
re
e
sc
a
le
S
e
m
ic
o
n
d
u
c
to
r,
I
Freescale Semiconductor, Inc.
For More Information On This Product,
Go to: www.freescale.com
n
c
..
.
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| FMC50DRAI | CONN EDGECARD 100PS R/A .100 SLD |
| MC68020EH25E | IC MPU 32BIT 33MHZ 132-PQFP |
| MC68020EH20E | IC MPU 32BIT 33MHZ 132-PQFP |
| MC68020EH16E | IC MPU 32BIT 33MHZ 132-PQFP |
| MC68020CEH25E | IC MPU 32BIT 33MHZ 132-PQFP |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| MC68020FC16 | 制造商:MOTOROLA 制造商全稱:Motorola, Inc 功能描述:MICROPROCESSORS USERS MANUAL |
| MC68020FC20 | 制造商:FREESCALE 制造商全稱:Freescale Semiconductor, Inc 功能描述:The first full 32-bit implementation of the M68000 family of microprocessors from Motorola |
| MC68020FC25 | 制造商:MOTOROLA 制造商全稱:Motorola, Inc 功能描述:MICROPROCESSORS USERS MANUAL |
| MC68020FC25E | 制造商:Rochester Electronics LLC 功能描述:32-BIT MPU - Bulk |
| MC68020FC33E | 制造商:Rochester Electronics LLC 功能描述:32-BIT MPU - Bulk |
發(fā)布緊急采購，3分鐘左右您將得到回復(fù)。