10.12 Inter-Integrate" />
參數(shù)資料
型號： MC56F8013VFAER2
廠商： Freescale Semiconductor
文件頁數(shù)： 15/126頁
文件大?。?/td> 0K
描述： IC DIGITAL SIGNAL CTLR 32-LQFP
標準包裝： 2,000
系列： 56F8xxx
核心處理器： 56800E
芯體尺寸： 16-位
速度： 32MHz
連通性： I²C，SCI，SPI
外圍設(shè)備： POR，PWM，WDT
輸入/輸出數(shù)： 26
程序存儲器容量： 16KB（8K x 16）
程序存儲器類型： 閃存
RAM 容量： 2K x 16
電壓 - 電源 (Vcc/Vdd)： 3 V ~ 3.6 V
數(shù)據(jù)轉(zhuǎn)換器： A/D 6x12b
振蕩器型： 內(nèi)部
工作溫度： -40°C ~ 105°C
封裝/外殼： 32-LQFP
包裝： 帶卷 (TR)
Inter-Integrated Circuit Interface (I2C) Timing
56F8013/56F8011 Data Sheet, Rev. 12
Freescale Semiconductor
111
10.12 Inter-Integrated Circuit Interface (I2C) Timing
Table 10-17 I2C Timing
Characteristic
Symbol
Standard Mode
Fast Mode
Unit
Minimum
Maximum
Minimum
Maximum
SCL Clock Frequency
fSCL
0100
0400
kHz
Hold time (repeated )
START condition. After
this period, the first clock
pulse is generated.
tHD; STA
4.0
0.6
μs
LOW period of the SCL
clock
tLOW
4.7
1.25
μs
HIGH period of the SCL
clock
tHIGH
4.0
0.6
μs
Set-up time for a repeated
START condition
tSU; STA
4.7
0.6
μs
Data hold time for I2C bus
devices
tHD; DAT
01
1. A device must internally provide a hold time of at least 300ns for the SDA signal (referred to the VIH min of the SCL
signal) to bridge the undefined region of the falling edge of SCL.
3.452
2. The maximum tHD; DAT has only to be met if the device does not stretch the LOW period (tLOW) of the SCL signal.
01
0.92
μs
Data set-up time
tSU; DAT
250
1003
3. A Fast mode I2C bus device can be used in a Standard mode I2C bus system, but the requirement tSU; DAT > = 250ns
must then be met. This will automatically be the case if the device does not stretch the LOW period of the SCL signal.
If such a device does stretch the LOW period of the SCL signal, it must output the next data bit to the SDA line
trmax + tSU; DAT = 1000 + 250 = 1250ns (according to the Standard mode I
2C bus specification) before the SCL line is
released.
ns
Rise time of both SDA and
SCL signals
tr
1000
2 +0.1Cb
4
4. Cb = total capacitance of the one bus line in pF.
300
ns
Fall time of both SDA and
SCL signals
tf
300
2 +0.1Cb
4
300
ns
Set-up time for STOP
condition
tSU; STO
4.0
0.6
μs
Bus free time between
STOP and START
condition
tBUF
4.7
1.3
μs
Pulse width of spikes that
must be suppressed by
the input filter
tSP
N/A
0.0
50
ns
相關(guān)PDF資料
PDF描述
MC56F8013MFAE IC DIGITAL SIGNAL CTLR 32-LQFP
VI-B7M-IY-F4 CONVERTER MOD DC/DC 10V 50W
VI-BVT-IY-F4 CONVERTER MOD DC/DC 6.5V 50W
VE-B6D-IY-B1 CONVERTER MOD DC/DC 85V 50W
VI-BVT-IY-F2 CONVERTER MOD DC/DC 6.5V 50W
相關(guān)代理商/技術(shù)參數(shù)
參數(shù)描述
MC56F8014 制造商:FREESCALE 制造商全稱:Freescale Semiconductor, Inc 功能描述:16-bit Digital Signal Controllers
MC56F8014E 制造商:FREESCALE 制造商全稱:Freescale Semiconductor, Inc 功能描述:16-bit Digital Signal Controllers
MC56F8014MFAE 功能描述:數(shù)字信號處理器和控制器 - DSP, DSC 16Bit DSPHC RoHS:否 制造商:Microchip Technology 核心:dsPIC 數(shù)據(jù)總線寬度:16 bit 程序存儲器大小:16 KB 數(shù)據(jù) RAM 大小:2 KB 最大時鐘頻率:40 MHz 可編程輸入/輸出端數(shù)量:35 定時器數(shù)量:3 設(shè)備每秒兆指令數(shù):50 MIPs 工作電源電壓:3.3 V 最大工作溫度:+ 85 C 封裝 / 箱體:TQFP-44 安裝風格:SMD/SMT
MC56F8014VFAE 功能描述:數(shù)字信號處理器和控制器 - DSP, DSC 16 BIT DSPHC BAHAMAS RoHS:否 制造商:Microchip Technology 核心:dsPIC 數(shù)據(jù)總線寬度:16 bit 程序存儲器大小:16 KB 數(shù)據(jù) RAM 大小:2 KB 最大時鐘頻率:40 MHz 可編程輸入/輸出端數(shù)量:35 定時器數(shù)量:3 設(shè)備每秒兆指令數(shù):50 MIPs 工作電源電壓:3.3 V 最大工作溫度:+ 85 C 封裝 / 箱體:TQFP-44 安裝風格:SMD/SMT
MC56F8023 制造商:FREESCALE 制造商全稱:Freescale Semiconductor, Inc 功能描述:16-bit Digital Signal Controllers
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