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參數(shù)資料
| 型號(hào)： | MC14517 |
| 廠商： | ON SEMICONDUCTOR |
| 英文描述： | Dual 64-Bit Static Shift Register |
| 中文描述： | 雙64位靜態(tài)移位寄存器 |
| 文件頁(yè)數(shù)： | 3/6頁(yè) |
| 文件大?。?/td> | 209K |
| 代理商： | MC14517 |
MOTOROLA CMOS LOGIC DATA
405
MC14517B
Output Rise and Fall Time
tTLH, tTHL = (1.5 ns/pF) CL + 25 ns
tTLH, tTHL = (0.75 ns/pF) CL + 12.5 ns
tTLH, tTHL = (0.65 ns/pF) CL + 9.5 ns
Propagation Delay Time
tPLH, tPHL = (1.7 ns/pF) CL + 390 ns
tPLH, tPHL = (0.66 ns/pF) CL + 177 ns
tPLH, tPHL = (0.5 ns/pF) CL + 115 ns
Clock Pulse Width
tTLH, tTHL
5.0
10
15
—
—
—
100
50
40
200
100
80
ns
tPLH, tPHL
5.0
10
15
—
—
—
475
210
140
770
300
215
ns
tWH
5.0
10
15
330
125
100
170
75
60
—
—
—
ns
Clock Pulse Frequency
fcl
5.0
10
15
—
—
—
3.0
6.7
8.3
1.5
4.0
5.3
MHz
Clock Pulse Rise and Fall Time
tTLH, tTHL
5.0
10
15
**See Note
—
Data to Clock Setup Time
tsu
5.0
10
15
0
10
15
– 40
– 15
0
—
—
—
ns
Data to Clock Hold Time
th
5.0
10
15
150
75
35
75
25
10
—
—
—
ns
Write Enable to Clock Setup Time
tsu
5.0
10
15
400
200
110
170
65
50
—
—
—
ns
Write Enable to Clock Release Time
trel
5.0
10
15
380
180
100
160
55
40
—
—
—
ns
*The formulas given are for the typical characteristics only at 25 C.
#Data labelled “Typ” is not to be used for design purposes but is intended as an indication of the IC’s potential performance.
** When shift register sections are cascaded, the maximum rise and fall time of the clock input should be equal to or less than the rise and fall
time of the data outputs, driving data inputs, plus the propagation delay of the output driving stage.
Figure 1. Power Dissipation Test Circuit and Waveform
CL
CL
CL
CL
CL
CL
CL
CL
VDD
Q16 Q32 Q48 Q64
Q16 Q32 Q48 Q64
VDD
VDD
VSS
VSS
D
C
WE
D
C
WE
VSS
ID
D
C
50
μ
F
REPETITIVE WAVEFORM
C
D
fo
(f = 1/2 fo)
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| MC14517BDWR2 | Dual 64-Bit Static Shift Register |
| MC14517BCP | Non-inverting High Speed MOSFET Driver with Active Pullup and Internal Regulator 5-SOT-23 |
| MC14517BDW | Dual 64-Bit Static Shift Register |
| MC145170D1 | LOW-VOLTAGE CMOS OCTAL BUFFER |
| MC14517 | LOW-VOLTAGE CMOS OCTAL BUFFER |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
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| MC145170D2R2 | 功能描述:鎖相環(huán) - PLL PLL Synthesizer RoHS:否 制造商:Silicon Labs 類型:PLL Clock Multiplier 電路數(shù)量:1 最大輸入頻率:710 MHz 最小輸入頻率:0.002 MHz 輸出頻率范圍:0.002 MHz to 808 MHz 電源電壓-最大:3.63 V 電源電壓-最小:1.71 V 最大工作溫度:+ 85 C 最小工作溫度:- 40 C 封裝 / 箱體:QFN-36 封裝:Tray |
| MC145170DT2 | 功能描述:鎖相環(huán) - PLL PLL Synthesizer RoHS:否 制造商:Silicon Labs 類型:PLL Clock Multiplier 電路數(shù)量:1 最大輸入頻率:710 MHz 最小輸入頻率:0.002 MHz 輸出頻率范圍:0.002 MHz to 808 MHz 電源電壓-最大:3.63 V 電源電壓-最小:1.71 V 最大工作溫度:+ 85 C 最小工作溫度:- 40 C 封裝 / 箱體:QFN-36 封裝:Tray |
| MC145170DT2R2 | 功能描述:IC SERIAL PLL FREQ SYNTH 16TSSOP RoHS:否 類別:集成電路 (IC) >> 時(shí)鐘/計(jì)時(shí) - 時(shí)鐘發(fā)生器，PLL，頻率合成器 系列:- 標(biāo)準(zhǔn)包裝:39 系列:- 類型:* PLL:帶旁路 輸入:時(shí)鐘 輸出:時(shí)鐘 電路數(shù):1 比率 - 輸入:輸出:1:10 差分 - 輸入:輸出:是/是 頻率 - 最大:170MHz 除法器/乘法器:無(wú)/無(wú) 電源電壓:2.375 V ~ 3.465 V 工作溫度:0°C ~ 70°C 安裝類型:* 封裝/外殼:* 供應(yīng)商設(shè)備封裝:* 包裝:* |
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