參數(shù)資料
型號(hào)： MC145152DW2R2
廠商： Freescale Semiconductor
文件頁(yè)數(shù)： 18/24頁(yè)
文件大?。?/td> 0K
描述： IC PAR-IN PLL FREQ SYNTH 28-SOIC
標(biāo)準(zhǔn)包裝： 1,000
類型： PLL 時(shí)鐘/頻率合成器
PLL： 是
輸入： 時(shí)鐘
輸出： CMOS
電路數(shù)： 1
比率 - 輸入:輸出： 1:1
差分 - 輸入:輸出： 無(wú)/無(wú)
頻率 - 最大： 25MHz
除法器/乘法器： 是/無(wú)
電源電壓： 3 V ~ 9 V
工作溫度： -40°C ~ 85°C
安裝類型： 表面貼裝
封裝/外殼： 28-SOIC（0.295"，7.50mm 寬）
供應(yīng)商設(shè)備封裝： 28-SOIC W
包裝： 帶卷 (TR)
其它名稱： MC145152DW2TR
MC145151-2 Parallel-Input (Interfaces with Single-Modulus Prescalers)
MC145151-2 and MC145152-2 Technical Data, Rev. 5
Freescale Semiconductor
3
Figure 2. MC145151-2 Block Diagram
1.2
Pin Descriptions
1.2.1
Input Pins
fin
Frequency Input (Pin 1)
Input to the
÷N portion of the synthesizer. f
in is typically derived from loop VCO and is ac coupled into
the device. For larger amplitude signals (standard CMOS logic levels) dc coupling may be used.
RA0 - RA2
Reference Address Inputs (Pins 5, 6, 7)
These three inputs establish a code defining one of eight possible divide values for the total reference
divider, as defined by the table below.
Pull-up resistors ensure that inputs left open remain at a logic 1 and require only a SPST switch to alter
data to the zero state.
Reference Address Code
Total
Divide
Value
RA2
RA1
RA0
0
1
0
1
0
1
0
1
0
1
0
1
0
1
8
128
256
512
1024
2048
2410
8192
14 x 8 ROM REFERENCE DECODER
14-BIT
÷ N COUNTER
φ
V
φ
R
14-BIT
÷ R COUNTER
TRANSMIT OFFSET ADDER
PHASE
DETECTOR
B
PHASE
DETECTOR
A
LOCK
DETECT
LD
PDout
RA2
fin
VDD
OSCin
OSCout
T/R
14
fV
N13
N11
N9
N7 N6
N4
N2
N0
NOTE: N0 - N13 inputs and inputs RA0, RA1, and RA2 have pull-up resistors that are not shown.
RA0
RA1
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