參數(shù)資料
型號: MC100ES60T23EFR2
廠商: IDT, Integrated Device Technology Inc
文件頁數(shù): 3/8頁
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描述: IC XLATOR LV PECL DUAL 8-SOIC
標準包裝: 2,500
系列: 100ES
邏輯功能: 變換器
位數(shù): 2
輸入類型: LVPECL
輸出類型: LVTTL
通道數(shù): 2
輸出/通道數(shù)目: 1
差分 - 輸入:輸出: 是/無
傳輸延遲(最大): 1.75ns
電源電壓: 3 V ~ 3.6 V
工作溫度: -40°C ~ 85°C
封裝/外殼: 8-SOIC(0.154",3.90mm 寬)
供應商設備封裝: 8-SOIC
包裝: 帶卷 (TR)
MC100ES60T23 REVISION 3 DECEMBER 14, 2012
3
2012 Integrated Device Technology, Inc.
MC100ES60T23 DATA SHEET
3.3V DUAL DIFFERENTIAL LVPECL TO LVTTL TRANSLATOR
Figure 2. TTL Output Loading Used for Device Evaluation
Table 4. LVTTL / LVCMOS Output DC Characteristics (VCC = 3.0 to 3.6 V); TA = 40°C to 85°C
Symbol
Characteristic
Condition
Min
Typ
Max
Unit
VOH
Output HIGH Voltage
IOH = –24 mA
2.4
V
VOL
Output LOW Voltage
IOL = 24 mA
0.5
V
IOS
Output Short Circuit Current
–140
–185
–275
mA
Table 5. AC Characteristics (VCC = 3.0 to 3.6 V; VEE = 0 V)(1); TA = 40°C to 85°C
1. LVTTL output RL = 500 to GND and CL = 20 pF to GND. Refer to Figure 2.
Symbol
Characteristic
Test Conditions
Min
Typ
Max
Unit
fOUT
Output Toggle Frequency(2)
2. fmax guaranteed for functionality only. VOL and VOH levels are guaranteed at DC only.
500
MHz
tPD
Propagation Delay
0.95
1.75
ns
tSK++
tSK--
tSKPP
tSKP
Data Path Skew++(3)
Data Path Skew--(3)
Part-to-Part Skew(3)
Pulse Skew(3)
3. Skews are measured between outputs under identical conditions.
120
140
500
250
ps
tJIT
Buffer Additive Phase Jitter, RMS;
refer to Additive Phase Jitter Section
CLK0/Q0
CLK1/Q1
125MHz, 12kHz - 20MHz
156.25MHz, 12kHz - 20MHz
125MHz, 12kHz - 20MHz
156.25MHz, 12kHz - 20MHz
0.40
0.18
0.38
0.21
ps
VPP
Input Voltage Swing (Differential)(4)
4. 200 mV input guarantees AC Characteristics.
200
1300
mV
VCMR
Differential Cross Point Voltage
VEE+1.2
VCC–0.3
V
tr / tf
Output Rise/Fall Times (0.8 V – 2.0 V)
50
250
ps
CHARACTERISTIC TEST
AC TEST LOAD
CL*
RL
GND
*CL includes fixtures capacitance
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參數(shù)描述
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