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參數(shù)資料
| 型號(hào)： | MB95F418KPMC-G-SNE2 |
| 廠商： | FUJITSU LTD |
| 元件分類： | 微控制器/微處理器 |
| 英文描述： | MICROCONTROLLER, PQFP80 |
| 封裝： | 12 X 12 MM, 1.70 MM HEIGHT, 0.50 MM PITCH, PLASTIC, LQFP-80 |
| 文件頁數(shù)： | 37/76頁 |
| 文件大小： | 3707K |
| 代理商： | MB95F418KPMC-G-SNE2 |
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MB95410H/470H Series
42
DS702-00004-0v01-E
(Continued)
Address
Register
abbreviation
Register name
R/W
Initial value
0FACH
PSSR2
UART/SIO dedicated baud rate generator prescaler select
register ch. 2
R/W
00000000B
0FADH
BRSR2
UART/SIO dedicated baud rate generator setting register
ch. 2
R/W
00000000B
0FAEH
—
(Disabled)
—
0FAFH
AIDRL
A/D input disable register (lower)
R/W
00000000B
0FB0H
LCDCC1
LCDC control register 1
R/W
00000000B
0FB1H
—
(Disabled)
—
0FB2H
LCDCE1
LCDC enable register 1
R/W
00111110B
0FB3H
LCDCE2
LCDC enable register 2
R/W
00000000B
0FB4H
LCDCE3
LCDC enable register 3
R/W
00000000B
0FB5H
LCDCE4
LCDC enable register 4
R/W
00000000B
0FB6H
LCDCE5
LCDC enable register 5
R/W
00000000B
0FB7H
LCDCE6
LCDC enable register 6
R/W
00000000B
0FB8H
—
(Disabled)
—
0FB9H
LCDCB1
LCDC blinking setting register 1
R/W
00000000B
0FBAH
LCDCB2
LCDC blinking setting register 2
R/W
00000000B
0FBBH,
0FBCH
—
(Disabled)
—
0FBDH
to
0FD8H
LCDRAM
LCDC display RAM (28 bytes)
R/W
00000000B
0FD9H
to
0FE1H
—
(Disabled)
—
0FE2H
EVCR
Event counter control register
R/W XXXXXXX0B
0FE3H
WCDR
Watch counter data register
R/W
00111111B
0FE4H
CRTH
Main CR clock trimming register (upper)
R/W 0XXXXXXXB
0FE5H
CRTL
Main CR clock trimming register (lower)
R/W 00XXXXXXB
0FE6H,
0FE7H
—
(Disabled)
—
0FE8H
SYSC
System control register
R/W
11000011B
0FE9H
CMCR
Clock monitoring control register
R/W
XX000000B
0FEAH
CMDR
Clock monitoring data register
R
00000000B
0FEBH
WDTH
Watchdog timer selection ID register (upper)
R
XXXXXXXXB
0FECH
WDTL
Watchdog timer selection ID register (lower)
R
XXXXXXXXB
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| MB95F474HPMC1-G-SNE2 | MICROCONTROLLER, PQFP64 |
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| MB95F476HPMC1-G-SNE2 | MICROCONTROLLER, PQFP64 |
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相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
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