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參數(shù)資料
| 型號： | MB91V108PFV |
| 廠商： | FUJITSU LTD |
| 元件分類： | 微控制器/微處理器 |
| 英文描述： | 32-BIT, RISC MICROCONTROLLER, PQFP120 |
| 封裝： | 16 X 16 MM, 0.50 MM PITCH, PLASTIC, LQFP-120 |
| 文件頁數(shù)： | 226/454頁 |
| 文件大?。?/td> | 6395K |
| 代理商： | MB91V108PFV |
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285
11.6 Hold Request Cancellation Requests
To execute high priority interrupt processing during CPU hold, the request of the hold
request issuing source must be canceled. The interrupt level used as the basis for
generating the cancellation request is set in the HRCL register.
s Basis for Generating Hold Request Cancellation Requests
When an interrupt source level that is greater than the interrupt level set in the HRCL register is
detected, a hold request cancellation request is generated.
If the HRCL register interrupt level is greater than the interrupt level after determining the
priority, a cancellation request is generated.
If the HRCL register interrupt level is less than or equal to the interrupt level after
determining the priority, no cancellation request is generated.
This cancellation request remains valid until the interrupt source used as the source for
generating cancellation requests is cleared. If cancellation of a hold request is requested during
DMA transfer, DMA transfer will not occur until the interrupt request is cleared; therefore, always
clear the corresponding interrupt source.
s Hold Request Cancellation Request Levels that Can be Set
The values that can be set in the HRCL register are the same as those of the ICR register. That
is, values between 10000B and 11111B are allowed.
When the HRCL register is set to 11111B, a cancellation request is generated for all interrupt
levels. When the HRCL register is set to 10000B, a cancellation request is generated for NMIs
only.
Table 11.6-1 "Settings of Interrupt Levels Used for Generating Hold Request Cancellation
Requests" lists the settings of the interrupt levels used for generating hold request cancellation
requests.
After a reset, the HRCL register is set to 11111 and DMA transfer is suppressed for all interrupt
levels.
Because DMA transfer cannot be performed when an interrupt occurs, set the HRCL register to
the required value.
Table 11.6-1 Settings of Interrupt Levels Used for Generating Hold Request Cancellation
Requests
HRCL register
Interrupt level used for generating cancellation requests
16
NMIs only
17
NMIs and interrupt level 16
18
NMIs and interrupt levels 16 and 17
31
NMIs and interrupt levels 16 to 30 (initial value)
相關PDF資料 |
PDF描述 |
|---|---|
| MB95F108AKSPFM | 8-BIT, FLASH, 10 MHz, MICROCONTROLLER, PQFP64 |
| MB95F108AKSPFV | 8-BIT, FLASH, 10 MHz, MICROCONTROLLER, PQFP64 |
| MB95F108AKWPFV | 8-BIT, FLASH, 10 MHz, MICROCONTROLLER, PQFP64 |
| MB95R203P-G-SH-JNE2 | MICROCONTROLLER, PDIP24 |
| MB95R203PF-G-JNE2 | MICROCONTROLLER, PDSO20 |
相關代理商/技術參數(shù) |
參數(shù)描述 |
|---|---|
| MB91V110 | 制造商:FUJITSU 制造商全稱:Fujitsu Component Limited. 功能描述:32-Bit RISC Microcontroller |
| MB91V210 | 制造商:FUJITSU 制造商全稱:Fujitsu Component Limited. 功能描述:32-bit Proprietary Microcontroller |
| MB91V210PB-ESE1 | 制造商:FUJITSU 制造商全稱:Fujitsu Component Limited. 功能描述:32-bit Proprietary Microcontroller |
| MB91V220 | 制造商:FUJITSU 制造商全稱:Fujitsu Component Limited. 功能描述:32-bit Microcontroller |
| MB91V220ACR-ES | 制造商:FUJITSU 制造商全稱:Fujitsu Component Limited. 功能描述:32-bit Microcontroller |
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