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參數(shù)資料
| 型號(hào)： | MB91340PMT |
| 元件分類： | 微控制器/微處理器 |
| 英文描述： | 32-BIT, MROM, 66 MHz, RISC MICROCONTROLLER, PQFP176 |
| 封裝： | PLASTIC, LQFP-176 |
| 文件頁數(shù)： | 19/126頁 |
| 文件大?。?/td> | 1501K |
| 代理商： | MB91340PMT |
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MB91340/MB91V340
115
(10) DMA Controller Timing
(VCC3
= 3.0 V to 3.6 V , VCC2 = 2.3 V to 2.7 V , VSS = DAVS = AVSS = 0 V, Ta = 10 °C to +70 °C)
[ For edge detection ] (Block/step transfer mode, burst transfer mode)
* : When fCPT
> fCP, tCYC becomes same as tCP.
[ For level detection ] (Demand transfer mode)
[ For all operation modes ]
(Continued)
Parameter
Sym-
bol
Pin name
Condition
Value
Unit
Remarks
Min
Max
DREQ input pulse width
tDRWL
DREQ0 to DREQ2
2 tCYC*
ns
DSTP input pulse width
tDSWH
DSTP0 to DSTP2
2 tCYC*
ns
Parameter
Sym-
bol
Pin name
Condition
Value
Unit
Remarks
Min
Max
DREQ setup time
tDRS
MCLK
DREQ0 to DREQ2
10
ns
DREQ hold time
tDRH
MCLK
DREQ0 to DREQ2
0
ns
DSTP setup time
tDSTPS
MCLK
DSTP0 to DSTP2
10
ns
DSTP hold time
tDSTPH
MCLK
DSTP0 to DSTP2
0
ns
Parameter
Sym-
bol
Pin name
Condition
Value
Unit
Remarks
Min
Max
DACK delay time
tDALCH
MCLK
DACK0 to DACK2
AWRxL* :
W02
= 0
3
ns
CS timing
6
ns
FR30 compatible
tDADLCH
AWRxL :
W02
= 1
3
ns
CS timing
6
ns
FR30 compatible
tCHDAH
tCYC
/ 2 + 6ns
CS timing
6
ns
FR30 compatible
DEOP delay
time
tDELCH
MCLK
DEOP0 to DEOP2
AWRxL :
W02
= 0
3
ns
CS timing
6
ns
FR30 compatible
tDEDLCH
AWRxL :
W02
= 1
3
ns
CS timing
6
ns
FR30 compatible
tCHDEH
tCYC
/ 2 + 6ns
CS timing
6
ns
FR30 compatible
相關(guān)PDF資料 |
PDF描述 |
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參數(shù)描述 |
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