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參數(shù)資料
| 型號(hào)： | MB91107PFV-G |
| 廠商： | FUJITSU LTD |
| 元件分類(lèi)： | 微控制器/微處理器 |
| 英文描述： | 32-BIT, 50 MHz, RISC MICROCONTROLLER, PQFP120 |
| 封裝： | PLASTIC, LQFP-120 |
| 文件頁(yè)數(shù)： | 64/111頁(yè) |
| 文件大?。?/td> | 1337K |
| 代理商： | MB91107PFV-G |
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MB91107
56
(2) Block diagram
X0
X1
PLL
1/2
R
|
B
U
S
Internal reset
CPU hold enable
DMA request
Power on cell
RST pin
GCR register
CPU gear
Status
transition
control
circuit
PDRR register
(Watchdog control section)
Timebase timer
CPU clock
Internal bus clock
External busclock
Internal bus
peripheral clock
STOP state
SLEEP state
CPU hold request
HST pin
mGear control
Peripheral
gear
Peripheral DMA clock
PCTR register
STCR register
Count clock
Watchdog F/F
(Reset cause circuit)
(DNA prohibit
circuit)
RSRR register
WPR register
CTBR register
Internal interrupt
Oscil-
lator
Selection
circuit
(Stop/sleep control section)
Reset
generation
F/F
Internal
clock
generator
circuit
Internal reset
相關(guān)PDF資料 |
PDF描述 |
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| MB91108PFV | 32-BIT, 50 MHz, RISC MICROCONTROLLER, PQFP120 |
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參數(shù)描述 |
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