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參數(shù)資料
| 型號(hào)： | MB90V570A |
| 廠商： | Fujitsu Limited |
| 英文描述： | 16-bit Proprietary Microcontroller |
| 中文描述： | 16位微控制器專有 |
| 文件頁(yè)數(shù)： | 90/135頁(yè) |
| 文件大?。?/td> | 2504K |
| 代理商： | MB90V570A |
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90
MB90570 Series
(6) Bus Read Timing
(AV
CC
= V
CC
= 5.0 V
±
10%, AV
SS
= V
SS
= 0.0 V, T
A
= –40
°
C to +85
°
C)
* :For t
CP
(internal operating clock cycle time), refer to “(3) Clock Timings.”
Parameter
Symbol
Pin name
Condition
Value
Unit
Remarks
Min.
Max.
—
ALE pulse width
t
LHLL
ALE
ALE,
A23 to A16,
AD15 to AD00
ALE,
AD15 to AD00
RD,
A23 to A16,
AD15 to AD00
A23 to A16,
AD15 to AD00
RD
RD,
AD15 to AD00
RD,
AD15 to AD00
ALE, RD
ALE,
A23 to A16
CLK,
A23 to A16,
AD15 to AD00
CLK, RD
ALE, RD
—
1 t
CP
*/2 – 20
ns
Effective address
→
ALE
↓
time
t
AVLL
1 t
CP
*/2 – 20
—
ns
ALE
↓
→
address
effective time
t
LLAX
1 t
CP
*/2 – 15
—
ns
Effective address
→
RD
↓
time
t
AVRL
1 t
CP
* – 15
—
ns
Effective address
→
valid data input
RD pulse width
t
AVDV
—
5 t
CP
*/2 – 60
ns
t
RLRH
3 t
CP
*/2 – 20
—
ns
RD
↓
→
valid data input t
RLDV
—
3 t
CP
*/2 – 60
ns
RD
↑
→
data hold time
t
RHDX
0
—
ns
RD
↑
→
ALE
↑
time
RD
↑
→
address
effective time
t
RHLH
1 t
CP
*/2 – 15
—
ns
t
RHAX
1 t
CP
*/2 – 10
—
ns
Effective address
→
CLK
↑
time
t
AVCH
1 t
CP
*/2 – 20
—
ns
RD
↓
→
CLK
↑
time
ALE
↓
→
RD
↓
time
t
RLCH
t
ALRL
1 t
CP
*/2 – 20
1 t
CP
*/2 – 15
—
—
ns
ns
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PDF描述 |
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