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參數(shù)資料
| 型號(hào)： | MB90F474LPFV |
| 廠商： | FUJITSU LTD |
| 元件分類： | 微控制器/微處理器 |
| 英文描述： | 16-Bit Proprietary Microcontroller |
| 中文描述： | 16-BIT, FLASH, 12 MHz, MICROCONTROLLER, PQFP100 |
| 封裝： | PLASTIC, LQFP-100 |
| 文件頁數(shù)： | 65/118頁 |
| 文件大?。?/td> | 555K |
| 代理商： | MB90F474LPFV |
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MB90470 Series
65
14. Watchdog Timer
The watchdog timer is a 2-bit counter that uses a count clock signal output by the timer base timer or watch
timer and will reset the CPU unless cleared within a specified period of time.
(1) Register List
(2) Block Diagram
Watchdog timer control register (WDTC)
0000A8
H
Default value
(
)
( X )
( R )
( X )
( R )
( X )
( R )
( X )
( W )
( 1 )
( W )
( 1 )
( W )
( 1 )
7
6
5
4
3
2
1
0
Reserved
( R )
( X )
PONR
WRST
ERST
SRST
WTE
WT1
WT0
PONR STBR WRST ERST SRST WTE
WT1
WT0
×
2
1
×
2
2
×
2
8
×
2
9
×
2
10
×
2
11
×
2
12
×
2
13
×
2
14
×
2
15
×
2
16
×
2
17
×
2
18
×
2
1
SCLK
HCLK signal / 2
CLR
CLR
×
2
2
×
2
8
×
2
9
×
2
10
×
2
11
×
2
12
×
2
13
×
2
14
×
2
15
×
2
16
×
2
17
×
2
18
2
4
4
Watchdog timer control register (WDTC)
Watch timer control register
(WT0) WDCS bit
Clock select register
(CKSCR) SCM bit
Watch mode start
Time base timer
mode start
Sleep mode start
Hold status start
Watchdog timer
CLR and start
Counter clear
control circuit
Watchdog reset
generator circuit
Internal reset
generator
circuit
2-bit counter
Count
clock
selector
Stop mode start
Clear
Time base counter
HCLK : Oscillator clock
SCLK : Sub-clock
相關(guān)PDF資料 |
PDF描述 |
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