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參數(shù)資料
| 型號： | MB90F474LPFV |
| 廠商： | FUJITSU LTD |
| 元件分類： | 微控制器/微處理器 |
| 英文描述： | 16-Bit Proprietary Microcontroller |
| 中文描述： | 16-BIT, FLASH, 12 MHz, MICROCONTROLLER, PQFP100 |
| 封裝： | PLASTIC, LQFP-100 |
| 文件頁數(shù)： | 58/118頁 |
| 文件大小： | 555K |
| 代理商： | MB90F474LPFV |
第1頁第2頁第3頁第4頁第5頁第6頁第7頁第8頁第9頁第10頁第11頁第12頁第13頁第14頁第15頁第16頁第17頁第18頁第19頁第20頁第21頁第22頁第23頁第24頁第25頁第26頁第27頁第28頁第29頁第30頁第31頁第32頁第33頁第34頁第35頁第36頁第37頁第38頁第39頁第40頁第41頁第42頁第43頁第44頁第45頁第46頁第47頁第48頁第49頁第50頁第51頁第52頁第53頁第54頁第55頁第56頁第57頁當前第58頁第59頁第60頁第61頁第62頁第63頁第64頁第65頁第66頁第67頁第68頁第69頁第70頁第71頁第72頁第73頁第74頁第75頁第76頁第77頁第78頁第79頁第80頁第81頁第82頁第83頁第84頁第85頁第86頁第87頁第88頁第89頁第90頁第91頁第92頁第93頁第94頁第95頁第96頁第97頁第98頁第99頁第100頁第101頁第102頁第103頁第104頁第105頁第106頁第107頁第108頁第109頁第110頁第111頁第112頁第113頁第114頁第115頁第116頁第117頁第118頁
MB90470 Series
58
10. 16-bit reload timer
The 16-bit reload timer provides a choice of two functions, one is an internal clock countdown synchronized with
any of 3 types of internal clock, and the other is an event count mode that counts down at detection of a given
edge of a pulse input externally. This timer defines an underflow as a transition of the count value from 0000
H
to FFFF
H
. Therefore, an underflow will occur at the count value “reload register setting count
+
1”. The count
operation includes a choice of reload mode in which the count set value is reloaded at each underflow event,
and one-shot mode in which the count stops at an underflow event. An interrupt can be generated when the
counter reaches an underflow, and the timer is DTC compatible.
(1) Register List
TMCSR (Timer control status registers)
Timer control status register (high)
Timer control status register (low)
16-bit timer register/16-bit reload register
TMR
/
TMRLR
(
high
)
TMR
/
TMRLR
(
low
)
0000CB
H
Read/write
Default value
0000CA
H
Read/write
Default value
0000CD
H
Read/write
Default value
0000CC
H
Read/write
Default value
(
)
(
)
(
)
(
)
(
)
(
)
(R/W)
( 0 )
(R/W)
( 0 )
(R/W)
( 0 )
(R/W)
( 0 )
15
14
13
12
11
10
9
8
(
)
(
)
CSL1
CSL0
MOD2
MOD1
(R/W)
( 0 )
(R/W)
( 0 )
(R/W)
( 0 )
(R/W)
( 0 )
(R/W)
( 0 )
(R/W)
( 0 )
(R/W)
( 0 )
7
6
5
4
3
2
1
0
OUTE
(R/W)
( 0 )
MOD0
OUTL
RELD
INTE
UF
CNTE
TRG
(R/W)
( X )
(R/W)
( X )
(R/W)
( X )
(R/W)
( X )
(R/W)
( X )
(R/W)
( X )
(R/W)
( X )
15
14
13
12
11
10
9
8
D14
(R/W)
( X )
D15
D13
D12
D11
D10
D09
D08
(R/W)
( X )
(R/W)
( X )
(R/W)
( X )
(R/W)
( X )
(R/W)
( X )
(R/W)
( X )
(R/W)
( X )
7
6
5
4
3
2
1
0
D06
(R/W)
( X )
D07
D05
D04
D03
D02
D01
D00
相關PDF資料 |
PDF描述 |
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