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參數(shù)資料
| 型號(hào)： | MB8117800A-70 |
| 廠商： | Electronic Theatre Controls, Inc. |
| 英文描述： | 2 M X 8 BIT FAST PAGE MODE DYNAMIC RAM |
| 中文描述： | 2的MX 8位快速頁面模式動(dòng)態(tài)隨機(jī)存儲(chǔ)器 |
| 文件頁數(shù)： | 22/27頁 |
| 文件大?。?/td> | 580K |
| 代理商： | MB8117800A-70 |
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22
MB8117800A-60/-70
A
0
to A
10
CAS
V
IH
V
IL
V
OH
V
OL
RAS
V
IH
V
IL
V
IH
V
IL
DQ
(Output)
Fig. 15 – HIDDEN REFRESH CYCLE
DESCRIPTION
A hidden refresh cycle may be performed while maintaining the latest valid data at the output by extending the active time of CAS
and cycling RAS. The refresh row address is provided by the on-chip refresh address counter. This eliminates the need for the ex-
ternal row address that is required by DRAMs that do not have CAS-before-RAS refresh capability.
WE
V
IH
V
IL
OE
V
IH
V
IL
V
IH
V
IL
DQ
(Input)
t
RC
t
RC
t
RAS
t
RP
t
RAS
t
OEL
t
RP
t
CRP
t
CHR
t
RSH
t
RCD
t
RAD
t
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AA
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CAC
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DZC
t
ON
t
DZO
t
OEA
t
OEZ
t
OED
t
OFF
t
OH
HIGH-Z
VALID DATA OUT
“H” or “L”
ROW
ADDRESS
COLUMN
ADDRESS
HIGH-Z
To Top / Lineup / Index
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PDF描述 |
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參數(shù)描述 |
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