參數(shù)資料
型號(hào)： MAX5946LETX+T
廠商： Maxim Integrated
文件頁(yè)數(shù)： 3/23頁(yè)
文件大小： 1102K
描述： IC CNTRLR PCI EXP DL 36TQFN
產(chǎn)品培訓(xùn)模塊： Lead (SnPb) Finish for COTS
Obsolescence Mitigation Program
標(biāo)準(zhǔn)包裝： 2,500
類型： 熱交換控制器
應(yīng)用： 通用型，PCI Express?
內(nèi)部開關(guān)： 無(wú)
電源電壓： 3.3V，12V
工作溫度： -40°C ~ 85°C
安裝類型： 表面貼裝
封裝/外殼： 36-WFQFN 裸露焊盤
供應(yīng)商設(shè)備封裝： 36-TQFN 裸露焊盤（6x6）
包裝： 帶卷 (TR)
Dual PCI Express, Hot-Plug
Controller
_______________________________________________________________________________________   3
ELECTRICAL CHARACTERISTICS (continued)
(V
12VIN
= V
12S_-
= V
12S_+
= 12V, V
3.3S_+
= V
3.3S_-
= V
3.3VAUXIN
= V
ON_
= V
AUXON_
= V
FON__
= 3.3V, PWRGD_ = FAULT_ = PORADJ
= TIM = OUTPUT_ = 12G_ = 3.3G_ = OPEN, INPUT_ = PRES_DET_ = PGND = GND, T
A
= -40癈 to +85癈, unless otherwise noted.
Typical values are at T
A
= +25癈.) (Note 1)
PARAMETER
YMB  L
CONDITIONS
MIN
TYP
MAX
NIT
.3V CONTROL
.3V Current-Limit Threshold
V
3.3S_+
 - V
3.3S_-
)
V
3.3ILIM
17
20
23
mV
.3G_ Gate Charge Current
I
3.3G_CHG
V
3.3G_
 = GND
4
5
6
礎(chǔ)
ON_ = GND, V
3.3G_
= 2V
50
150
250
礎(chǔ)
.3G_ Gate Discharge
urrent
I
3.3G_DIS
O utp ut shor
t- ci r
cui t cond i
ti on, str
ong
 g ate p ul l d ow n
to r
eg ul ati
on, V
3 .3 S _ +
 - V
3 .3 S _
 e 1V , V
3 .3 G_
= 5V
100
150
220
mA
.3G_ Gate High Voltage
V
3.3G_
- V
3.3S_+
)
V
3.3G_H
Sourcing 1礎(chǔ)
4.5
5.5
6.8
V
.3G_ Threshold Voltage For
WRGD_ Assertion (Note 2)
V
PGTH3.3
Referred to V
3.3VAUXIN
, I
3.3G_
 = 1礎(chǔ)
-3.0
-4
-4.5
V
.3S_- Input Bias Current
1
礎(chǔ)
.3S_+ Input Bias Current
20
60
礎(chǔ)
.3V AUXILIARY SUPPLY
.3VAUXIN Supply Voltage
Range
V
3.3VAUXIN
3.0
3.3
3.6
V
3.3VAUXIN rising
2.52
2.65
2.78
V
.3VAUXIN Undervoltage
Lockout
V
3 .3 V A U X U V L O
Hysteresis
30
mV
.3VAUXIN Supply Current
V
3.3VAUXIN
= 3.6V
1.5
3
mA
.3VAUXIN to 3.3VAUXO_
Maximum Dropout
I
3.3VAUXO_
= 375mA
225
mV
.3VAUXO_ Current-Limit
hreshold
3.3VAUXO_ shorted to GND
376
470
564
mA
.3VAUXO_ Threshold For
WRGD_ Assertion
V
3.3VAUXIN
 - V
3.3VAUXO_
)
Note 3)
V
PGTH3.3AUX
400
mV
LOGIC SIGNALS
Rising edge
1.0
2.0
V
Input-Logic Threshold
ON_, FON_, AUXON_,
RES-DET_, INPUT_)
Hysteresis
25
mV
Input Bias Current
ON_, AUXON_, INPUT_)
1
礎(chǔ)
ON_, PRES-DET_ Internal
Pullup
25
50
75
k&
N_, AUXON_ High-to-Low
Deglitch Time
4
祍
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