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參數(shù)資料
| 型號： | M34519M8-XXXFP |
| 元件分類： | 微控制器/微處理器 |
| 英文描述： | 4-BIT, MROM, 6 MHz, MICROCONTROLLER, PDSO42 |
| 封裝： | 0.450 INCH, 0.80 MM PITCH, PLASTIC, SSOP-42 |
| 文件頁數(shù)： | 97/138頁 |
| 文件大小： | 1146K |
| 代理商： | M34519M8-XXXFP |
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4519 Group
Rev.3.01
2005.06.15
page 59 of 160
REJ03B0007-0301
Fig. 48 Structure of reset pin and its peripherals,, and power-on reset operation
Name
D0–D5
D6/CNTR0
D7/CNTR1
P00–P03
P10–P13
P20/SCK, P21/SOUT, P22/SIN
P30/INT0, P31/INT1, P32, P33
P40/AIN4–P43/AIN7
P50–P53
P60/AIN0–P63/AIN3
Notes 1: Output latch is set to “1.”
2: Output structure is N-channel open-drain.
3: Pull-up transistor is turned OFF.
Function
D0–D5
D6
D7
P00–P03
P10–P13
P20–P22
P30–P33
P40–P43
P50–P53
P60–P63
State
High-impedance (Notes 1, 2)
High-impedance (Notes 1, 2, 3)
High-impedance (Note 1)
High-impedance (Notes 1, 2)
High-impedance (Note 1)
(1) Power-on reset
Reset can be automatically performed at power on (power-on re-
set) by the built-in power-on reset circuit. When the built-in
power-on reset circuit is used, the time for the supply voltage to
rise from 0 V until the value of supply voltage reaches the minimum
operating voltage must be set to 100
s or less.
If the rising time exceeds 100
s, connect a capacitor between the
RESET pin and VSS at the shortest distance, and input “L” level to
RESET pin until the value of supply voltage reaches the minimum
operating voltage.
Table 1 Port state at reset
RESET pin
WEF
Watchdog reset signal
(Note 1)
Pull-up transistor
(Note 1)
Power-on reset circuit
Voltage drop detection circuit
VDD (Note 3)
100
s or less
(Note 2)
Internal reset signal
Power-on
Reset released
Internal reset signal
Reset
state
Notes 1:
This symbol represents a parasitic diode.
2: Applied potential to RESET pin must be VDD or less.
3: Keep the value of supply voltage to the minimum value
or more of the recommended operating conditions.
Power-on reset circuit output
SRST instruction
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