參數(shù)資料
型號: M30800FCGP
廠商: Mitsubishi Electric Corporation
英文描述: SINGLE-CHIP 16-BIT CMOS MICROCOMPUTER
中文描述: 單片16位CMOS微機(jī)
文件頁數(shù): 244/317頁
文件大小: 4621K
代理商: M30800FCGP
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deveopmen
Timing (Vcc = 3V)
Preliminary Specifications REV.D
Specifications in this manual are tentative and subject to change.
Mitsubishi microcomputers
M16C/80 (100-pin version) group
SINGLE-CHIP 16-BIT CMOS MICROCOMPUTER
244
Figure 1.28.17. V
CC
=3V timing diagram (3)
BCLK
ALE
25ns.max
t
d(BCLK-ALE)
t
h(BCLK-ALE)
-2ns.min
RD
25ns.max
-3ns.min
Hi-Z
DB
0ns.min
0ns.min
t
d(BCLK-RD)
40ns.min*1
t
ac2(RD-DB)*2
t
ac2(AD-DB)*2
CSi
t
d(BCLK-CS)
25ns.max*1
ADi
BHE
t
h(BCLK-AD)
0ns.min
t
h(BCLK-CS)
0ns.min
tcyc
t
d(BCL25ns.max*1
t
ac2(RD-DB)
=(tcyc/2 x m-55)ns.max (m=3, 5 and 7 when 1 wait, 2 wait and 3 wait, respectively.)
t
ac2(AD-DB)
=(tcyc x n-55)ns.max (n=2, 3 and 4 when 1 wait, 2 wait and 3 wait, respectively.)
WR,WRL,
WRH
25ns.max
0ns.min
t
h(WR-DB)*3
BCLK
CSi
25ns.max
ADi
BHE
25ns.max
0ns.min
0ns.min
tcyc
DBi
t
d(BCLK-WR)
ALE
25ns.max
t
d(BCLK-ALE)
-2ns.min
Vcc=3V
t
h(BCLK-RD)
t
h(RD-DB)
t
h(RD-AD)
t
su(DB-BCLK)
t
h(RD-CS)
0ns.min
t
h(BCLK-WR)
t
d(BCLK-CS)
t
d(BCLK-AD)
t
h(BCLK-AD)
t
h(BCLK-CS)
t
h(WR-CS)*3
t
d(DB-WR)*3
t
h(WR-AD)*3
t
d(DB-WR)
=(tcyc x n-40)ns.min
(n=1, 2 and 3 when 1 wait, 2 wait and 3 wait, respectively.)
t
h(WR-DB)
=(tcyc/2-20)ns.min
t
h(WR-AD)
=(tcyc/2-20)ns.min
t
h(WR-CS)
=(tcyc/2-20)ns.min
t
w(WR)
=(tcyc/2 x n-20)ns.min
(n=1, 3 and 5 when 1 wait, 2 wait and 3 wait, respectively.)
*3:It depends on operation frequency.
Measuring conditions
V
CC
=3V±10%
Input timing voltage
:Determined with V
IH
=1.5V, V
IL
=0.5V
Output timing voltage
:Determined with V
OH
=1.5V, V
OL
=1.5V
*1:It is a guarantee value with being alone. 55ns.max garantees as t
d(BCLK-AD)
+t
su(DB-BCLK)
.
*2:It depends on operation frequency.
t
h(BCLK-ALE)
Read Timing
Write Timing
Memory expansion Mode and Microprocessor Mode (with 2 wait)
t
w(WR)*3
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M30800FGFP 制造商:MITSUBISHI 制造商全稱:Mitsubishi Electric Semiconductor 功能描述:SINGLE-CHIP 16-BIT CMOS MICROCOMPUTER
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