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參數資料
| 型號： | M30624MGA-379FP |
| 廠商： | Mitsubishi Electric Corporation |
| 英文描述： | SYSTEM BASIC CHIPS |
| 中文描述： | 單片16位CMOS微機 |
| 文件頁數： | 195/274頁 |
| 文件大?。?/td> | 3495K |
| 代理商： | M30624MGA-379FP |
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Mitsubishi microcomputers
M16C / 62A Group
SINGLE-CHIP 16-BIT CMOS MICROCOMPUTER
Timing (Vcc = 3V)
195
t
d(BCLK-AD)
t
h(BCLK-AD)
t
h(RD-AD)
t
h(WR-AD)
Address output delay time
Address output hold time (BCLK standard)
Address output hold time (RD standard)
Address output hold time (WR standard)
60
ns
ns
ns
ns
t
d(BCLK-CS)
t
h(BCLK-CS)
t
d(BCLK-ALE)
t
h(BCLK-ALE)
t
d(BCLK-RD)
t
h(BCLK-RD)
t
d(BCLK-WR)
t
h(BCLK-WR)
t
d(BCLK-DB)
t
h(BCLK-DB)
t
d(DB-WR)
t
h(WR-DB)
Note 1: Calculated according to the BCLK frequency as follows:
Chip select output delay time
Chip select output hold time (BCLK standard)
ALE signal output delay time
ALE signal output hold time
RD signal output delay time
RD signal output hold time
WR signal output delay time
WR signal output hold time
Data output delay time (BCLK standard)
Data output hold time (BCLK standard)
Data output delay time (WR standard)
Data output hold time (WR standard)(Note2)
60
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
4
0
0
4
60
—
4
60
0
60
0
80
4
(Note1)
0
td(DB – WR) =
f(BCLK) X 2
10
9
– 80
[ns]
Symbol
Standard
Min.
Measuring condition
Max.
Parameter
Unit
Note 2: This is standard value shows the timing when the output is off,
and doesn't show hold time of data bus.
Hold time of data bus is different by capacitor volume and pull-up
(pull-down) resistance value.
Hold time of data bus is expressed in
t = –CR X ln (1 – V
OL
/ V
CC
)
by a circuit of the right figure.
For example, when V
OL
= 0.2V
CC
, C = 30pF, R = 1k
, hold time
of output “L” level is
t = – 30pF X 1k
X ln (1 – 0.2V
CC
/ V
CC
)
= 6.7ns.
DBi
R
C
Note 3: Specify a product of -40°C to 85°C to use it.
Switching characteristics (referenced to V
CC
= 3V, V
SS
= 0V at Ta =
–
20
o
C to 85
o
C /
–
40
o
C to
85
o
C(Note3), CM15=
“
1
”
unless otherwise specified)
V
CC
= 3V
Figure 1.23.7
Table 1.23.37. Memory expansion and microprocessor modes (with no wait)
Figure 1.23.7. Port P0 to P10 measurement circuit
P6
P7
P8
P10
P9
P0
P1
P2
P3
P4
P5
30pF
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