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參數(shù)資料
| 型號： | M1AFS250-FQN180 |
| 元件分類： | FPGA |
| 英文描述： | FPGA, 250000 GATES, PBCC180 |
| 封裝： | 0.50 MM PITCH, QFN-180 |
| 文件頁數(shù)： | 63/318頁 |
| 文件大?。?/td> | 10129K |
| 代理商： | M1AFS250-FQN180 |
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Actel Fusion Mixed-Signal FPGAs
Pr el iminar y v1 .7
2- 139
Hot-Swap Support
Hot-swapping (also called hot plugging) is the operation of hot insertion or hot removal of a card
in (or from) a powered-up system. The levels of hot-swap support and examples of related
applications are described in Table 2-71. The I/Os also need to be configured in hot insertion mode
if hot plugging compliance is required.
Table 2-71 Levels of Hot-Swap Support
Hot
Swapping
Level
Description
Power
Applied
to Device Bus State
Card
Ground
Connection
Device
Circuitry
Connected
to Bus Pins
Example of
Application with
Cards that Contain
Fusion Devices
Compliance of
Fusion Devices
1
Cold-swap
No
–
System and card
with Actel FPGA chip
are powered down,
then card gets
plugged into system,
then power supplies
are turned on for
system but not for
FPGA on card.
Compliant I/Os
can but do not
have to be set to
hot insertion
mode.
2
Hot-swap
while reset
Yes
Held in
reset state
Must be
made and
maintained
for 1 ms
before,
during, and
after
insertion/
removal
–
In PCI hot plug
specification, reset
control circuitry
isolates the card
busses until the card
supplies are at their
nominal operating
levels and stable.
Compliant I/Os
can but do not
have to be set to
hot insertion
mode.
3
Hot-swap
while bus
idle
Yes
Held idle
(no
ongoing
I/O
processes
during
insertion/re
moval)
Same as Level
2
Must
remain
glitch-free
during
power-up
or power-
down
Board bus shared
with card bus is
"frozen," and there
is no toggling
activity on bus. It is
critical that the logic
states set on the bus
signal do not get
disturbed during
card
insertion/removal.
Compliant with
cards with two
levels of
staging. I/Os
have to be set to
hot insertion
mode.
4
Hot-swap
on an active
bus
Yes
Bus may
have active
I/O
processes
ongoing,
but device
being
inserted or
removed
must be
idle.
Same as Level
2
Same as
Level 3
There is activity on
the system bus, and
it is critical that the
logic states set on
the bus signal do not
get disturbed during
card
insertion/removal.
Compliant with
cards with two
levels of
staging. I/Os
have to be set to
hot insertion
mode.
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| M1AFS250-FQNG180 | FPGA, 250000 GATES, PBCC180 |
| M1AFS250-FFG256 | FPGA, 250000 GATES, PBGA256 |
| M1AFS250-FFGG256 | FPGA, 250000 GATES, PBGA256 |
| M1AFS250-FPQ208 | FPGA, 250000 GATES, PQFP208 |
| M1AFS250-FPQG208 | FPGA, 250000 GATES, PQFP208 |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| M1AFS250-FQN256ES | 制造商:ACTEL 制造商全稱:Actel Corporation 功能描述:Actel Fusion Mixed-Signal FPGAs |
| M1AFS250-FQN256I | 制造商:ACTEL 制造商全稱:Actel Corporation 功能描述:Actel Fusion Mixed-Signal FPGAs |
| M1AFS250-FQN256PP | 制造商:ACTEL 制造商全稱:Actel Corporation 功能描述:Actel Fusion Mixed-Signal FPGAs |
| M1AFS250-FQNG180 | 制造商:Microsemi Corporation 功能描述:FPGA FUSION 250K GATES 130NM 1.5V 180QFN EP - Trays |
| M1AFS250-FQNG256ES | 制造商:ACTEL 制造商全稱:Actel Corporation 功能描述:Actel Fusion Mixed-Signal FPGAs |
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