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參數(shù)資料
| 型號： | M1AFS250-FPQ208 |
| 元件分類： | FPGA |
| 英文描述： | FPGA, 250000 GATES, PQFP208 |
| 封裝： | 0.50 MM PITCH, PQFP-208 |
| 文件頁數(shù)： | 83/318頁 |
| 文件大小： | 10129K |
| 代理商： | M1AFS250-FPQ208 |
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Actel Fusion Mixed-Signal FPGAs
Pr el iminar y v1 .7
2- 157
User I/O Naming Convention
Due to the comprehensive and flexible nature of Fusion device user I/Os, a naming scheme is used
to show the details of the I/O (Figure 2-105 on page 2-158 and Figure 2-106 on page 2-158). The
name identifies to which I/O bank it belongs, as well as the pairing and pin polarity for differential
I/Os.
I/O Nomenclature
= Gmn/IOuxwByVz
Gmn is only used for I/Os that also have CCC access—i.e., global pins.
G= Global
m
= Global pin location associated with each CCC on the device: A (northwest corner), B (northeast corner), C
(east middle), D (southeast corner), E (southwest corner), and F (west middle).
n
= Global input MUX and pin number of the associated Global location m, either A0, A1, A2, B0, B1, B2, C0,
C1, or C2. Figure 2-22 on page 2-28 shows the three input pins per clock source MUX at CCC location m.
u
= I/O pair number in the bank, starting at 00 from the northwest I/O bank and proceeding in a clockwise
direction.
x
= P (Positive) or N (Negative) for differential pairs, or R (Regular – single-ended) for the I/Os that support
single-ended and voltage-referenced I/O standards only. U (Positive-LVDS only) or V (Negative-LVDS
only) restrict the I/O differential pair from being selected as an LVPECL pair.
w
= D (Differential Pair), P (Pair), or S (Single-Ended). D (Differential Pair) if both members of the pair are
bonded out to adjacent pins or are separated only by one GND or NC pin; P (Pair) if both members of the
pair are bonded out but do not meet the adjacency requirement; or S (Single-Ended) if the I/O pair is not
bonded out. For Differential (D) pairs, adjacency for ball grid packages means only vertical or horizontal.
Diagonal adjacency does not meet the requirements for a true differential pair.
B
= Bank
y
= Bank number (0–3). The Bank number starts at 0 from the northwest I/O bank and proceeds in a
clockwise direction.
V
= Reference voltage
z
= Minibank number
相關PDF資料 |
PDF描述 |
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| M1AFS250-FPQG256ES | 制造商:ACTEL 制造商全稱:Actel Corporation 功能描述:Actel Fusion Mixed-Signal FPGAs |
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