Revision 4 2-27 Global Input Selections Each global buffer, as well as the PLL reference clock, can be driven " />
參數(shù)資料
型號(hào)： M1AFS250-2PQ208I
廠商： Microsemi SoC
文件頁(yè)數(shù)： 273/334頁(yè)
文件大?。?/td> 0K
描述： IC FPGA 2MB FLASH 250K 208-PQFP
標(biāo)準(zhǔn)包裝： 24
系列： Fusion®
RAM 位總計(jì)： 36864
輸入/輸出數(shù)： 93
門數(shù)： 250000
電源電壓： 1.425 V ~ 1.575 V
安裝類型： 表面貼裝
工作溫度： -40°C ~ 100°C
封裝/外殼： 208-BFQFP
供應(yīng)商設(shè)備封裝： 208-PQFP（28x28）
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Fusion Family of Mixed Signal FPGAs
Revision 4
2-27
Global Input Selections
Each global buffer, as well as the PLL reference clock, can be driven from one of the following (Figure 2-
3 dedicated single-ended I/Os using a hardwired connection
2 dedicated differential I/Os using a hardwired connection
The FPGA core
Notes:
1. Represents the global input pins. Globals have direct access to the clock conditioning block and are not
routed via the FPGA fabric. Refer to the "User I/O Naming Convention" section on page 2-161 for more
information.
2. Instantiate the routed clock source input as follows:
a) Connect the output of a logic element to the clock input of the PLL, CLKDLY, or CLKINT macro.
b) Do not place a clock source I/O (INBUF or INBUF_LVPECL/LVDS) in a relevant global pin location.
3. LVDS-based clock sources are available in the east and west banks on all Fusion devices.
Figure 2-22 Clock Input Sources Including CLKBUF, CLKBUF_LVDS/LVPECL, and CLKINT
+
Source for CCC
(CLKA or CLKB or CLKC)
Each shaded box represents an
input buffer called out by the
appropriate name: INBUF or
INBUF_LVDS/LVPECL.
To Core
Routed Clock
(from FPGA core)
2
Sample Pin Names
GAA0
1
GAA1
1
GAA2
1
GAA[0:2]: GA represents global in the northwest corner
of the device. A[0:2]: designates specific A clock source.
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PDF描述
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M1AFS250-2PQG208I 功能描述:IC FPGA 2MB FLASH 250K 208-PQFP RoHS:是 類別:集成電路 (IC) >> 嵌入式 - FPGA（現(xiàn)場(chǎng)可編程門陣列） 系列:Fusion® 標(biāo)準(zhǔn)包裝:40 系列:SX-A LAB/CLB數(shù):6036 邏輯元件/單元數(shù):- RAM 位總計(jì):- 輸入/輸出數(shù):360 門數(shù):108000 電源電壓:2.25 V ~ 5.25 V 安裝類型:表面貼裝 工作溫度:0°C ~ 70°C 封裝/外殼:484-BGA 供應(yīng)商設(shè)備封裝:484-FPBGA（27X27）
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