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參數(shù)資料
| 型號： | LTC1412CG#PBF |
| 廠商： | Linear Technology |
| 文件頁數(shù)： | 11/16頁 |
| 文件大?。?/td> | 0K |
| 描述： | IC A/D CONV 12BIT SAMPLNG 28SSOP |
| 標(biāo)準(zhǔn)包裝： | 47 |
| 位數(shù)： | 12 |
| 采樣率（每秒）： | 3M |
| 數(shù)據(jù)接口： | 并聯(lián) |
| 轉(zhuǎn)換器數(shù)目： | 1 |
| 功率耗散（最大）： | 220mW |
| 電壓電源： | 雙 ± |
| 工作溫度： | 0°C ~ 70°C |
| 安裝類型： | 表面貼裝 |
| 封裝/外殼： | 28-SSOP（0.209"，5.30mm 寬） |
| 供應(yīng)商設(shè)備封裝： | 28-SSOP |
| 包裝： | 管件 |
| 輸入數(shù)目和類型： | 2 個單端，雙極；1 個差分，雙極 |
| 產(chǎn)品目錄頁面： | 1346 (CN2011-ZH PDF) |
4
LTC1412
TI I G CHARACTERISTICS
W U
(Note 5)
SYMBOL
PARAMETER
CONDITIONS
MIN
TYP
MAX
UNITS
fSAMPLE(MAX)
Maximum Sampling Frequency
q
3
MHz
tTHROUGHPUT
Throughput Time (Acquisition + Conversion)
q
333
ns
tCONV
Conversion Time
q
240
283
ns
tACQ
Acquisition Time
q
20
50
ns
t1
CS
↓ to CONVST↓ Setup Time
(Notes 9, 10)
q
5ns
t2
CONVST Low Time
(Note 10)
q
20
ns
t3
CONVST to BUSY Delay
CL = 25pF
5
ns
q
20
ns
t4
Data Ready Before BUSY
↑
–20
0
20
ns
q
–25
25
ns
t5
Delay Between Conversions
(Note 10)
q
50
ns
t6
Data Access Time After CS
↓
CL = 25pF
10
35
ns
q
45
ns
t7
Bus Relinquish Time
830
ns
LTC1412C
q
35
ns
LTC1412I
q
40
ns
t8
CONVST High Time
q
20
ns
t9
Aperture Delay of Sample-and-Hold
– 1
ns
The q denotes specifications which apply over the full operating
temperature range; all other limits and typicals TA = 25°C.
Note 1: Absolute Maximum Ratings are those values beyond which the life
of a device may be impaired.
Note 2: All voltage values are with respect to ground with DGND and
AGND wired together (unless otherwise noted).
Note 3: When these pin voltages are taken below VSS or above VDD, they
will be clamped by internal diodes. This product can handle input currents
greater than 100mA below VSS or above VDD without latchup.
Note 4: When these pin voltages are taken below VSS they will be clamped
by internal diodes. This product can handle input currents greater than
100mA below VSS without latchup. These pins are not clamped to VDD.
Note 5: VDD = 5V, fSAMPLE = 3MHz and tr = tf = 5ns unless otherwise
specified.
Note 6: Linearity, offset and full-scale specifications apply for a single-
ended AIN input with AIN– grounded.
Note 7: Integral nonlinearity is defined as the deviation of a code from a
straight line passing through the actual endpoints of the transfer curve.
The deviation is measured from the center of the quantization band.
Note 8: Bipolar offset is the offset voltage measured from – 0.5LSB
when the output code flickers between 0000 0000 0000 and
1111 1111 1111.
Note 9: Guaranteed by design, not subject to test.
Note 10: Recommended operating conditions.
TI I G DIAGRA
U
WW
DATA (N – 1)
DB11 TO DB0
CONVST
BUSY
CS
1412 TD
t2
tCONV
t3
t1
t5
t4
t6
t7
DATA N
DB11 TO DB0
DATA (N + 1)
DB11 TO DB0
DATA
相關(guān)PDF資料 |
PDF描述 |
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參數(shù)描述 |
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| LTC1412IG#TR | 功能描述:IC ADC 12BIT 3MSPS SAMPLE 28SSOP RoHS:否 類別:集成電路 (IC) >> 數(shù)據(jù)采集 - 模數(shù)轉(zhuǎn)換器 系列:- 標(biāo)準(zhǔn)包裝:1,000 系列:- 位數(shù):12 采樣率（每秒）:300k 數(shù)據(jù)接口:并聯(lián) 轉(zhuǎn)換器數(shù)目:1 功率耗散（最大）:75mW 電壓電源:單電源 工作溫度:0°C ~ 70°C 安裝類型:表面貼裝 封裝/外殼:24-SOIC（0.295"，7.50mm 寬） 供應(yīng)商設(shè)備封裝:24-SOIC 包裝:帶卷 (TR) 輸入數(shù)目和類型:1 個單端，單極；1 個單端，雙極 |
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