參數(shù)資料
型號： LPC47S422QFP
廠商： STANDARD MICROSYSTEMS CORP
元件分類： 外設(shè)及接口
英文描述： ENHANCED SUPER I/O WITH LPC INTERFACE FOR SERVER APPLICATIONS
中文描述： MULTIFUNCTION PERIPHERAL, PQFP100
封裝： QFP-100
文件頁數(shù)： 76/264頁
文件大?。?/td> 1342K
代理商： LPC47S422QFP
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Bit 0
This bit can be used in either a hardwired prioritized or polled environment to indicate whether an interrupt
is pending. When bit 0 is a logic "0", an interrupt is pending and the contents of the IIR may be used as a
pointer to the appropriate internal service routine. When bit 0 is a logic "1", no interrupt is pending.
Bits 1 and 2
These two bits of the IIR are used to identify the highest priority interrupt pending as indicated by the
Interrupt Control Table.
Bit 3
In non-FIFO mode, this bit is a logic "0". In FIFO mode this bit is set along with bit 2 when a timeout
interrupt is pending.
Bits 4 and 5
These bits of the IIR are always logic "0".
Bits 6 and 7
These two bits are set when the FIFO CONTROL Register bit 0 equals 1.
Table 29 - Interrupt Control
FIFO
MODE
ONLY
REGISTER
INTERRUPT SET AND RESET FUNCTIONS
BIT 3
BIT 2
BIT 1
BIT 0
LEVEL
TYPE
76
INTERRUPT
IDENTIFICATION
PRIORITY
INTERRUPT
INTERRUPT
SOURCE
INTERRUPT
RESET
CONTROL
-
Reading the Line
Status Register
0
0
0
1
0
1
1
0
Highest
-
None
Receiver Line
Status
None
Overrun Error,
Parity Error,
Framing Error or
Break Interrupt
Receiver Data
Available
0
1
0
0
Second
Received Data
Available
Read Receiver
Buffer or the FIFO
drops below the
trigger level.
Reading the
Receiver Buffer
Register
1
1
0
0
Second
Character
Timeout
Indication
No Characters
Have Been
Removed From or
Input to the RCVR
FIFO during the
last 4 Char times
and there is at
least 1 char in it
during this time
Transmitter
Holding Register
Empty
0
0
1
0
Third
Transmitter
Holding
Register Empty
Reading the IIR
Register (if Source
of Interrupt) or
Writing the
Transmitter
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