參數(shù)資料
型號(hào)： LFXP15E-4FN256C
廠商： Lattice Semiconductor Corporation
文件頁數(shù)： 244/397頁
文件大?。?/td> 0K
描述： IC FPGA 15.5KLUTS 188I/O 256-BGA
標(biāo)準(zhǔn)包裝： 90
系列： XP
邏輯元件/單元數(shù)： 15000
RAM 位總計(jì)： 331776
輸入/輸出數(shù)： 188
電源電壓： 1.14 V ~ 1.26 V
安裝類型： 表面貼裝
工作溫度： 0°C ~ 85°C
封裝/外殼： 256-BGA
供應(yīng)商設(shè)備封裝： 256-FPBGA（17x17）
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13-19
Lattice Semiconductor
LatticeXP sysCONFIG Usage Guide
VHDL:
component STRTUP
port(STRTUP: in STD_ULOGIC );
end component;
attribute syn_noprune: boolean ;
attribute syn_noprune of STRTUP: component is true;
begin
u1: STRTUP port map (UCLK =><clock name>);
INBUF
The I/O INBUF option will disable all unused input buffers to save power. INBUF mode limits some of the function-
ality of Boundary Scan. For Boundary Scan testing it is recommended that the I/O Power Save mode be set to ON
so that all of the I/Os will be fully functional.
Technical Support Assistance
Hotline:
1-800-LATTICE (North America)
+1-503-268-8001 (Outside North America)
e-mail:
techsupport@latticesemi.com
Internet: www.latticesemi.com
Revision History
Date
Version
Change Summary
February 2005
01.0
Initial release.
March 2005
01.1
Changed Figure 12-1 to make it more understandable
Changed Table 12-5 to make it more understandable
Changed CFG[0:1] to CFG[1:0]
Added msb, lsb references to D[0:7]
Added Max Config Bits Table
July 2005
01.2
Changed INITN description, INITN is low during SDM configuration
September 2005
01.3
Added information on how to use the sysCONFIG dual-purpose pins as
GPIO.
February 2006
01.4
Removed "pull-up" from TDO signal.
August 2007
01.5
Nomenclature for Power Save feature changed to INBUF.
September 2007
01.6
Updated Dual-Purpose sysCONFIG Pins text section.
March 2008
01.7
Updated PROGRAMN text section.
Updated CSN and SC1N text section.
Updated Bypass Overflow Option text section.
Updated Flow-Through Overflow Option text section.
Updated Slave Parallel Mode text section.
July 2008
01.8
Updated LatticeXP Device Preference List table.
Updated Wake-Up Sequence to Internal Clock waveform.
Replaced Wake-up Clock Selection text section with new Start_Up
Clock Selection text section.
September 2008
01.9
Updated CCLK text section.
相關(guān)PDF資料
PDF描述
AMC26DREI-S93 CONN EDGECARD 52POS .100 EYELET
ACC40DREI-S93 CONN EDGECARD 80POS .100 EYELET
ABC40DREI-S93 CONN EDGECARD 80POS .100 EYELET
LT3029HMSE#PBF IC REG LDO ADJ .5A 16MSOP
LT3015IT-5#PBF IC REG LDO -5V 1.5A TO-220-5
相關(guān)代理商/技術(shù)參數(shù)
參數(shù)描述
LFXP15E-4FN256I 功能描述:FPGA - 現(xiàn)場可編程門陣列 15.4K LUTs 188 IO 1. 2V -4 Spd I RoHS:否 制造商:Altera Corporation 系列:Cyclone V E 柵極數(shù)量: 邏輯塊數(shù)量:943 內(nèi)嵌式塊RAM - EBR:1956 kbit 輸入/輸出端數(shù)量:128 最大工作頻率:800 MHz 工作電源電壓:1.1 V 最大工作溫度:+ 70 C 安裝風(fēng)格:SMD/SMT 封裝 / 箱體:FBGA-256
LFXP15E-4FN388C 功能描述:FPGA - 現(xiàn)場可編程門陣列 15.4K LUTs 268 IO 1. 2V -4 Spd RoHS:否 制造商:Altera Corporation 系列:Cyclone V E 柵極數(shù)量: 邏輯塊數(shù)量:943 內(nèi)嵌式塊RAM - EBR:1956 kbit 輸入/輸出端數(shù)量:128 最大工作頻率:800 MHz 工作電源電壓:1.1 V 最大工作溫度:+ 70 C 安裝風(fēng)格:SMD/SMT 封裝 / 箱體:FBGA-256
LFXP15E-4FN388I 功能描述:FPGA - 現(xiàn)場可編程門陣列 15.4K LUTs 268 IO 1. 2V -4 Spd I RoHS:否 制造商:Altera Corporation 系列:Cyclone V E 柵極數(shù)量: 邏輯塊數(shù)量:943 內(nèi)嵌式塊RAM - EBR:1956 kbit 輸入/輸出端數(shù)量:128 最大工作頻率:800 MHz 工作電源電壓:1.1 V 最大工作溫度:+ 70 C 安裝風(fēng)格:SMD/SMT 封裝 / 箱體:FBGA-256
LFXP15E-4FN484C 功能描述:FPGA - 現(xiàn)場可編程門陣列 15.4K LUTs 1.2V -4 S pd RoHS:否 制造商:Altera Corporation 系列:Cyclone V E 柵極數(shù)量: 邏輯塊數(shù)量:943 內(nèi)嵌式塊RAM - EBR:1956 kbit 輸入/輸出端數(shù)量:128 最大工作頻率:800 MHz 工作電源電壓:1.1 V 最大工作溫度:+ 70 C 安裝風(fēng)格:SMD/SMT 封裝 / 箱體:FBGA-256
LFXP15E-4FN484I 功能描述:FPGA - 現(xiàn)場可編程門陣列 15.4K LUTs 1.2V -4 S pd I RoHS:否 制造商:Altera Corporation 系列:Cyclone V E 柵極數(shù)量: 邏輯塊數(shù)量:943 內(nèi)嵌式塊RAM - EBR:1956 kbit 輸入/輸出端數(shù)量:128 最大工作頻率:800 MHz 工作電源電壓:1.1 V 最大工作溫度:+ 70 C 安裝風(fēng)格:SMD/SMT 封裝 / 箱體:FBGA-256
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