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參數(shù)資料
| 型號(hào)： | LFEC3E-5T144C |
| 廠商： | LATTICE SEMICONDUCTOR CORP |
| 元件分類(lèi)： | FPGA |
| 英文描述： | LatticeECP/EC Family Data Sheet |
| 中文描述： | FPGA, 384 CLBS, 3100 GATES, 420 MHz, PQFP144 |
| 封裝： | 20 X 20 MM, TQFP-144 |
| 文件頁(yè)數(shù)： | 7/117頁(yè) |
| 文件大?。?/td> | 557K |
| 代理商： | LFEC3E-5T144C |
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2-4
Architecture
Lattice Semiconductor
LatticeECP/EC Family Data Sheet
Figure 2-4. Slice Diagram
Table 2-1. Slice Signal Descriptions
Function
Input
Input
Input
Input
Input
Input
Input
Input
Output
Output
Output
Output
Output
1. See Figure 2-3 for connection details.
2. Requires two PFUs.
Type
Signal Names
A0, B0, C0, D0 Inputs to LUT4
A1, B1, C1, D1 Inputs to LUT4
M0
M1
CE
LSR
CLK
FCIN
F0, F1
Q0, Q1
OFX0
OFX1
FCO
Description
Data signal
Data signal
Multi-purpose
Multi-purpose
Control signal
Control signal
Control signal
Inter-PFU signal
Data signals
Data signals
Data signals
Data signals
Inter-PFU signal
Multipurpose Input
Multipurpose Input
Clock Enable
Local Set/Reset
System Clock
Fast Carry In
LUT4 output register bypass signals
Register Outputs
Output of a LUT5 MUX
Output of a LUT6, LUT7, LUT8
For the right most PFU the fast carry chain output
1
2
MUX depending on the slice
1
LUT4 &
CARRY
LUT4 &
CARRY
Slice
A0
B0
C0
D0
FF/
Latch
OFX0
F0
Q0
A1
B1
C1
D1
CI
CI
CO
CO
F
SUM
CE
CLK
LSR
FF/
Latch
OFX1
F1
Q1
F
SUM
D
D
M1
M0
To / From
Different slice / PFU
To / From
Different slice / PFU
LUT
Expansion
Mux
OFX0
From
Routing
To
Routing
Control Signals
selected and
inverted per
slice in routing
Interslice signals
are not shown
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| LFEC3E-5T144I | LatticeECP/EC Family Data Sheet |
| LFEC40E-3F256C | LatticeECP/EC Family Data Sheet |
| LFEC40E-3F256I | LatticeECP/EC Family Data Sheet |
| LFEC40E-3F484C | LatticeECP/EC Family Data Sheet |
| LFEC40E-3F484I | LatticeECP/EC Family Data Sheet |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
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| LFEC3E-5T144I | 制造商:LATTICE 制造商全稱(chēng):Lattice Semiconductor 功能描述:LatticeECP/EC Family Data Sheet |
| LFEC3E-5TN100C | 功能描述:FPGA - 現(xiàn)場(chǎng)可編程門(mén)陣列 3.1K LUTs Pb-Free RoHS:否 制造商:Altera Corporation 系列:Cyclone V E 柵極數(shù)量: 邏輯塊數(shù)量:943 內(nèi)嵌式塊RAM - EBR:1956 kbit 輸入/輸出端數(shù)量:128 最大工作頻率:800 MHz 工作電源電壓:1.1 V 最大工作溫度:+ 70 C 安裝風(fēng)格:SMD/SMT 封裝 / 箱體:FBGA-256 |
| LFEC3E-5TN100I | 制造商:LATTICE 制造商全稱(chēng):Lattice Semiconductor 功能描述:LatticeECP/EC Family Data Sheet |
| LFEC3E-5TN144C | 功能描述:FPGA - 現(xiàn)場(chǎng)可編程門(mén)陣列 3.1K LUTs Pb-Free RoHS:否 制造商:Altera Corporation 系列:Cyclone V E 柵極數(shù)量: 邏輯塊數(shù)量:943 內(nèi)嵌式塊RAM - EBR:1956 kbit 輸入/輸出端數(shù)量:128 最大工作頻率:800 MHz 工作電源電壓:1.1 V 最大工作溫度:+ 70 C 安裝風(fēng)格:SMD/SMT 封裝 / 箱體:FBGA-256 |
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