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參數(shù)資料
| 型號： | LC5256MC |
| 廠商： | Lattice Semiconductor Corporation |
| 英文描述： | 3.3V, 2.5V and 1.8V In-System Programmable eXpanded Programmable Logic Device XPLD⑩ Family |
| 中文描述： | 3.3，2.5V和1.8V在系統(tǒng)可編程擴展可編程邏輯器件XPLD⑩家庭 |
| 文件頁數(shù)： | 74/92頁 |
| 文件大?。?/td> | 378K |
| 代理商： | LC5256MC |
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Lattice Semiconductor
ispXPLD 5000MX Family Data Sheet
74
Global Clock LVDS pair options: GCLK0 and GCLK1, as well as GCLK2 and GCLK3, can be paired together to
receive differencial clocks; where GCLK0 and GCLK3 are the positive LVDS inputs.
0
0
126N
126P
S26
S24
S13
S12
-
-
S27
S25
—
—
C4
D5
ispXPLD 5768MX Logic Signal Connections (Continued)
sysIO Bank LVDS Pair
Primary Macrocell/
Function
Alternate Outputs
Macrocell 1
Alternate
Inputs
256 fpBGA
Ball Number
484 fpBGA
Ball Number
Macrocell 2
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