參數(shù)資料
型號： LC4128C-27T128C
廠商： LATTICE SEMICONDUCTOR CORP
元件分類： PLD
英文描述： 3.3V/2.5V/1.8V In-System Programmable SuperFAST High Density PLDs
中文描述： EE PLD, 2.7 ns, PQFP128
封裝： TQFP-128
文件頁數(shù)： 38/74頁
文件大?。?/td> 255K
代理商： LC4128C-27T128C
Lattice Semiconductor
ispMACH 4000V/B/C/Z Family Data Sheet
38
Signal Descriptions
Signal Names
Description
TMS
Input – This pin is the IEEE 1149.1 Test Mode Select input, which is used to control
the state machine
Input – This pin is the IEEE 1149.1 Test Clock input pin, used to clock through the
state machine
Input – This pin is the IEEE 1149.1 Test Data In pin, used to load data
Output – This pin is the IEEE 1149.1 Test Data Out pin used to shift data out
These pins are con
fi
gured to be either Global Output Enable Input or as general I/O
pins
Ground
Not Connected
The power supply pins for logic core
These pins are con
fi
gured to be either CLK input or as an input
The power supply pins for each I/O bank
Input/Output
1
– These are the general purpose I/O used by the logic array. y is GLB
reference (alpha) and z is macrocell reference (numeric). z: 0-15
ispMACH 4032
ispMACH 4064
ispMACH 4128
ispMACH 4256
ispMACH 4384
ispMACH 4512
1. In some packages, certain I/O are only available for use as inputs. See the signal connections table for details.
TCK
TDI
TDO
GOE0/IO, GOE1/IO
GND
NC
V
CC
CLK0/I, CLK1/I, CLK2/I, CLK3/I
V
CCO0
, V
CCO1
yzz
y: A-B
y: A-D
y: A-H
y: A-P
y: A-P, AX-HX
y: A-P, AX-PX
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PDF描述
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