參數(shù)資料
型號： KS0123
廠商： SAMSUNG SEMICONDUCTOR CO. LTD.
英文描述： DIGITAL VIDEO ENCODER
中文描述： 數(shù)字視頻編碼器
文件頁數(shù)： 19/44頁
文件大?。?/td> 456K
代理商： KS0123
KS0123 Data Sheet
MULTIMEDIA VIDEO
PAGE 19 OF 44
Modified on May/04/2000
General Purpose I/O Port and Other Signals
Pins D7 through D0 form a general purpose I/O port where some pins have a dual function. The list below indicates
the pin functionality. The directions of the I/Os are controlled by the DDR register.
The CSYN (composite sync) output is shared with D0 pin, and is programmed with the DDR0 and CSDIS control
bits as shown below.
The CLAMP output is shared with D1 pin, and is programmed with the DDR1 and CLMDIS control bits as shown
below.
Table 5: General Purpose I/O Functions
Pin
Function
D7 / PAL_ID
General purpose I/O port; also used as the PAL_ID (PAL phase identification) signal
input in the analog genlock mode. (see page 15)
D6 / SC_SYNC
General purpose I/O port; also used as the SC_SYNC (subcarrier sync) signal
input.(see page 15)
D5 - D4
General purpose I/O ports only.
D3/HSYN
General purpose I/O port in slave mode. HSYN output in Master mode.(see
page 15)
D2/FIELD
General purpose I/O port in slave mode. FIELD output in Master mode.(see
page 15)
D1/CLAMP
General purpose I/O port; also used as the CLAMP (clamp gate) output signal.
D0/CSYN
General purpose I/O port; also used as the CSYN (composite sync) output signal.
Table 6: Control of Pin D0/CSYN
DDR0
reg.
CSDIS
reg.
GPP0 read value
Effect of a GPP0 write on
D0/CSYN
Configuration
0
X
Logic state applied to D0
no effect
general purpose input
1
1
not defined
outputs GPP0 logic state
general purpose output
1
0
not defined
no effect
CSYN output
Table 7: Control of Pin D1/CLAMP
DDR1
reg
CLMDIS
reg
GPP1 read value
Effect of a GPP1 write on
D1/CLAMP
Configuration
0
X
Logic state applied to D1
no effect
general purpose input
1
1
not defined
outputs GPP1 logic state
general purpose output
1
0
not defined
no effect
CLAMP output
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