參數(shù)資料
型號(hào)： KMPC852TCZT100A
廠商： Freescale Semiconductor
文件頁(yè)數(shù)： 54/80頁(yè)
文件大?。?/td> 0K
描述： IC MPU PWRQUICC 100MHZ 256PBGA
標(biāo)準(zhǔn)包裝： 2
系列： MPC8xx
處理器類(lèi)型： 32-位 MPC8xx PowerQUICC
速度： 100MHz
電壓： 1.8V
安裝類(lèi)型： 表面貼裝
封裝/外殼： 256-BGA
供應(yīng)商設(shè)備封裝： 256-PBGA（23x23）
包裝： 托盤(pán)
MPC852T PowerQUICC Hardware Specifications, Rev. 4
58
Freescale Semiconductor
FEC Electrical Characteristics
Table 26 provides information about the MII transmit signal timing,.
Figure 60 shows the MII transmit signal timing diagram.
Figure 60. MII Transmit Signal Timing Diagram
15.3
MII Async Inputs Signal Timing (MII_CRS, MII_COL)
Table 27 provides information about the MII async inputs signal timing.
Figure 61 shows the MII asynchronous inputs signal timing diagram.
Figure 61. MII Async Inputs Timing Diagram
Table 26. MII Transmit Signal Timing
Num
Characteristic
Min
Max
Unit
M5
MII_TX_CLK to MII_TXD[3:0], MII_TX_EN, MII_TX_ER invalid
5
—
ns
M6
MII_TX_CLK to MII_TXD[3:0], MII_TX_EN, MII_TX_ER valid
—
25
—
M7
MII_TX_CLK pulse width high
35%
65%
MII_TX_CLK period
M8
MII_TX_CLK pulse width low
35%
65%
MII_TX_CLK period
Table 27. MII Async Inputs Signal Timing
Num
Characteristic
Min
Max
Unit
M9
MII_CRS, MII_COL minimum pulse width
1.5
—
MII_TX_CLK period
MII_TX_CLK (Input)
MII_TXD[3:0] (Outputs)
MII_TX_EN
MII_TX_ER
M5
M7
M8
M6
MII_CRS, MII_COL
M9
相關(guān)PDF資料
PDF描述
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參數(shù)描述
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