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參數(shù)資料
| 型號： | KM48S8030B |
| 廠商： | SAMSUNG SEMICONDUCTOR CO. LTD. |
| 英文描述： | 2M x 8Bit x 4 Banks Synchronous DRAM(2M x 8位 x 4組同步動態(tài)RAM) |
| 中文描述： | 200萬× 8位× 4銀行同步DRAM（2米× 8位× 4組同步動態(tài)RAM）的 |
| 文件頁數(shù)： | 27/43頁 |
| 文件大?。?/td> | 625K |
| 代理商： | KM48S8030B |
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TIMING DIAGRAM - III
CMOS SDRAM
0 1 2 3 4 5 6 7 8 9 10 11 12 13 14 15 16 17 18 19
ELECTRONICS
REV. 2 Mar. '98
Single Bit Read-Write-Read Cycle(Same Page) @CAS Latency=3, Burst Length=1
: Don't care
tRCD
*Note 1
tSS
tSH
tRP
tCCD
tSS
*Note 2
tSH
tRAC
tSAC
tSLZ
tOH
tSH
tSS
tSS
tSH
tSS
tSH
CLOCK
CKE
CS
RAS
CAS
ADDR
BA
0
~
BA
1
A
10
/AP
DQ
WE
DQM
Row Active
Read
Write
Read
Row Active
Precharge
tCH
tCC
tCL
tRAS
tRC
HIGH
tSH
tSH
tSS
tSS
*Note 2,3
BS
*Note 2,3 *Note 4
BS
*Note 4
*Note 3
*Note 3
*Note 3
Rb
Cc
Cb
Ca
Ra
BS
BS
BS
BS
Ra
Rb
Qc
Db
Qa
*Note 2,3
*Note 2
相關(guān)PDF資料 |
PDF描述 |
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參數(shù)描述 |
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