參數(shù)資料
型號(hào)： ISPPAC-CLK5320S-01T64I
廠商： Lattice Semiconductor Corporation
文件頁數(shù)： 6/56頁
文件大?。?/td> 0K
描述： IC BUFFER FANOUT ISP UNIV 64TQFP
標(biāo)準(zhǔn)包裝： 160
系列： ispClock™
類型： 時(shí)鐘發(fā)生器，扇出配送，零延遲緩沖器
PLL： 帶旁路
輸入： HSTL，LVCMOS，LVDS，LVPECL，LVTTL，SSTL
輸出： eHSTL，HSTL，LVCMOS，LVTTL，SSTL
電路數(shù)： 1
比率 - 輸入:輸出： 2:20
差分 - 輸入:輸出： 是/無
頻率 - 最大： 267MHz
除法器/乘法器： 是/無
電源電壓： 3 V ~ 3.6 V
工作溫度： -40°C ~ 85°C
安裝類型： 表面貼裝
封裝/外殼： 64-LQFP
供應(yīng)商設(shè)備封裝： 64-TQFP（10x10）
包裝： 托盤
Lattice Semiconductor
ispClock5300S Family Data Sheet
14
JTAG Interface and Programming Mode
Symbol
Parameter
Condition
Min.
Typ.
Max.
Units
fMAX
Maximum TCK Clock Frequency
—
25
MHz
tCKH
TCK Clock Pulse Width, High
20
—
ns
tCKL
TCK Clock Pulse Width, Low
20
—
ns
tISPEN
Program Enable Delay Time
15
—
s
tISPDIS
Program Disable Delay Time
30
—
s
tHVDIS
High Voltage Discharge Time, Program
30
—
s
tHVDIS
High Voltage Discharge Time, Erase
200
—
s
tCEN
Falling Edge of TCK to TDO Active
—
15
ns
tCDIS
Falling Edge of TCK to TDO Disable
—
15
ns
tSU1
Setup Time
8
—
ns
tH
Hold Time
10
—
ns
tCO
Falling Edge of TCK to Valid Output
—
15
ns
tPWV
Verify Pulse Width
30
—
s
tPWP
Programming Pulse Width
20
—
ms
tBEW
Bulk Erase Pulse Width
200
—
ms
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PDF描述
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ISPPACCLK5320S-01TN64C 制造商:LATTICE 制造商全稱:Lattice Semiconductor 功能描述:In-System Programmable, Zero-Delay, Universal Fan-Out Buffer, Single-Ended
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