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參數(shù)資料
| 型號： | ISL9003AIRUMZ-T |
| 廠商： | INTERSIL CORP |
| 元件分類： | 基準電壓源/電流源 |
| 英文描述： | Low Noise LDO with Low IQ, High PSRR |
| 中文描述： | 3 V FIXED POSITIVE LDO REGULATOR, 0.325 V DROPOUT, PDSO6 |
| 封裝： | 1.60 X 1.60 MM, ROHS COMPLIANT, PLASTIC, MO-229, UTDFN-6 |
| 文件頁數(shù)： | 7/11頁 |
| 文件大小： | 210K |
| 代理商： | ISL9003AIRUMZ-T |
7
FN6299.1
December 21, 2006
Pin Description
Typical Application
FIGURE 17. SPECTRAL NOISE DENSITY vs FREQUENCY
5 LD SC-70
PIN #
6 LD μTDFN
PIN #
PIN NAME
DESCRIPTION
1
6
VIN
Supply Voltage/LDO Input. Connect a 1
μ
F capacitor to GND.
2
2
GND
GND is the connection to system ground. Connect to PCB Ground plane.
3
4
EN
Output Enable. When this signal goes high, the LDO is turned on.
4
3
CBYP
Reference Bypass Capacitor Pin. Optionally connect capacitor of value 0.01μF to 1μF between this pin
and GND to tune in the desired noise and PSRR performance.
5
1
VO
LDO Output. Connect a 1μF capacitor of value to GND.
-
5
NC
No Connect.
Typical Performance Curves
(Continued)
S
μ
V
√
H
2.000
1.000
0.100
0.010
0.001
10
100
1k
10k
100k
1M
FREQUENCY (Hz)
V
IN
= 3.9V
V
O
= 1.8V
C
BYP
= 0.1
μ
F
C
IN
= 1
μ
F
C
LOAD
= 1
μ
F
100
μ
A
10mA
C1, C2: 1μF X5R CERAMIC CAPACITOR
C3: 0.1μF X5R CERAMIC CAPACITOR
ISL9003A (SC-70)
VIN
GND
VO
CBYP
5
4
1
2
VIN (2.3-5V)
VOUT
C1
C2
EN
3
ENABLE
OFF
ON
C3
C1, C2: 1μF X5R CERAMIC CAPACITOR
C3: 0.1μF X5R CERAMIC CAPACITOR
ISL9003A (μTDFN)
VO
GND
VIN
EN
5
4
1
2
VOUT
C1
C2
CBYP
3
ENABLE
OFF
ON
C3
NC
VIN (2.3-5V)
6
ISL9003A
相關(guān)PDF資料 |
PDF描述 |
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參數(shù)描述 |
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