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參數(shù)資料
| 型號： | IR3Y48M |
| 廠商： | Sharp Corporation |
| 英文描述： | CCD Signal Process & Digital Interface IC |
| 中文描述： | CCD信號處理 |
| 文件頁數(shù)： | 21/31頁 |
| 文件大?。?/td> | 176K |
| 代理商： | IR3Y48M |
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IR3Y48M
21
1. Reference name
2. Register address
[Write]
Test register
A
3
A
2
A
1
A
0
1
0
0
0
3. Register bit assignment
D
9
X
ADIN test mode
0
D
0
0
D
1
0
D
2
0
D
3
0
D
4
0
D
5
0
D
6
X
D
7
X
D
8
Functions
Default
<->
4. Register operations
Test register (D
6
) is prepared for ADIN AC coupled
input. Using this mode the signal center is set to
V
COM
. No clamp signals are required at this mode.
Connect C-coupled output to ADIN. The resistance
50 k$ between ADIN (14 pin) and CLPCAP (13
pin) stabilize the DC level at ADIN pin.
0
1
Normal operation
V
COM
centered ADIN for AC coupling
CONTROLS
OPERATIONS
D
8
D
7
D
6
D
5
D
4
D
3
D
2
D
1
D
0
D
9
ADIN test mode
X : Don't care
NOTE :
D
5
to D
0
must always be "0".
相關(guān)PDF資料 |
PDF描述 |
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參數(shù)描述 |
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