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參數(shù)資料
| 型號(hào)： | IF280C52EXXX-12:RD |
| 廠商： | TEMIC SEMICONDUCTORS |
| 元件分類： | 微控制器/微處理器 |
| 英文描述： | 8-BIT, MROM, 12 MHz, MICROCONTROLLER, PQFP44 |
| 文件頁(yè)數(shù)： | 15/238頁(yè) |
| 文件大小： | 4549K |
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111
8006K–AVR–10/10
ATtiny24/44/84
When a capture is triggered according to the ICES1 setting, the counter value is copied into the
Input Capture Register (ICR1). The event will also set the Input Capture Flag (ICF1), and this
can be used to cause an Input Capture Interrupt, if this interrupt is enabled.
When the ICR1 is used as TOP value (see description of the WGM13:0 bits located in the
TCCR1A and the TCCR1B Register), the ICP1 is disconnected and consequently the Input Cap-
ture function is disabled.
Bit 5 – Res: Reserved Bit
This bit is reserved for future use. For ensuring compatibility with future devices, this bit must be
written to zero when TCCR1B is written.
Bits 4:3 – WGM13, WGM12: Waveform Generation Mode
See TCCR1A Register description.
Bits 2:0 – CS12, CS11, CS10: Clock Select
The three Clock Select bits select the clock source to be used by the Timer/Counter, see Figure
12-10 and Figure 12-11.
If external pin modes are used for the Timer/Counter1, transitions on the T1 pin will clock the
counter even if the pin is configured as an output. This feature allows software control of the
counting.
12.11.3
TCCR1C – Timer/Counter1 Control Register C
Bit 7 – FOC1A: Force Output Compare for Channel A
Bit 6 – FOC1B: Force Output Compare for Channel B
The FOC1A/FOC1B bits are only active when the WGM13:0 bits specifies a non-PWM mode.
However, for ensuring compatibility with future devices, these bits must be set to zero when
TCCR1A is written when operating in a PWM mode. When writing a logical one to the
FOC1A/FOC1B bit, an immediate compare match is forced on the Waveform Generation unit.
The OC1A/OC1B output is changed according to its COM1x1:0 bits setting. Note that the
Table 12-6.
Clock Select Bit Description
CS12
CS11
CS10
Description
0
No clock source (Timer/Counter stopped).
00
1
clkI/O/1 (No prescaling)
01
0
clk
I/O/8 (From prescaler)
01
1
clkI/O/64 (From prescaler)
10
0
clk
I/O/256 (From prescaler)
10
1
clk
I/O/1024 (From prescaler)
1
0
External clock source on T1 pin. Clock on falling edge.
1
External clock source on T1 pin. Clock on rising edge.
Bit
765
4
3
210
FOC1A
FOC1B
–
TCCR1C
Read/Write
W
R
Initial Value
0
相關(guān)PDF資料 |
PDF描述 |
|---|---|
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相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
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