- 您現(xiàn)在的位置：買賣IC網(wǎng) > PDF目錄10545 > IDT82P2281PFG (IDT, Integrated Device Technology Inc)TXRX T1/E1/J1 LONG/SHORT 80-TQFP PDF資料下載
參數(shù)資料
| 型號(hào)： | IDT82P2281PFG |
| 廠商： | IDT, Integrated Device Technology Inc |
| 文件頁數(shù)： | 347/371頁 |
| 文件大?。?/td> | 0K |
| 描述： | TXRX T1/E1/J1 LONG/SHORT 80-TQFP |
| 標(biāo)準(zhǔn)包裝： | 30 |
| 類型： | 收發(fā)器 |
| 規(guī)程： | T1，E1，J1 |
| 電源電壓： | 3 V ~ 3.6 V |
| 安裝類型： | 表面貼裝 |
| 封裝/外殼： | 80-LQFP |
| 供應(yīng)商設(shè)備封裝： | 80-TQFP（14x14） |
| 包裝： | 托盤 |
| 其它名稱： | 800-2344 82P2281PFG IDT82P2281PFG-ND |
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IDT82P2281
SINGLE T1/E1/J1 LONG HAUL / SHORT HAUL TRANSCEIVER
77
August 20, 2009
from the multiplexed bus. When the data on the multiplexed bus is input
to the link, the position of the data is arranged by setting the timeslot off-
set.
In the Transmit Multiplexed mode, the timing signal on the MTSCK
pin and the framing pulse on the MTSFS pin are provided by the system
side. The signaling bits on the MTSIG pin are per-timeslot aligned with
the corresponding data on the MTSD pin.
In the Transmit Multiplexed mode, the data on the system interface
is clocked by the MTSCK. The active edge of the MTSCK used to sam-
ple the pulse on the MTSFS is determined by the FE bit. The active
edge of the MTSCK used to sample the data on the MTSD and MTSIG
is determined by the DE bit. If the FE bit and the DE bit are not equal,
the pulse on the MTSFS is ahead. The MTSCK can be selected by the
CMS bit to be the same rate as the data rate on the system side (8.192
MHz) or double the data rate (16.384 MHz). If the speed of the MTSCK
is double the data rate, there will be two active edges in one bit duration.
In this case, the EDGE bit determines the active edge to sample the
data on the MTSD and MTSIG pins. The pulse on the MTSFS pin is
always sampled on its first active edge.
In the Transmit Multiplexed mode, the MTSFS can indicate the
Basic frame, CRC Multi-frame and/or Signaling Multi-frame of the first
link. The indications are selected by the FSTYP bit. The active polarity of
the MTSFS is selected by the FSINV bit. If the pulse on the MTSFS pin
is not an integer multiple of 125
s, this detection will be indicated by the
TCOFAI bit. If the TCOFAE bit is enabled, an interrupt will be reported by
the INT pin when the TCOFAI bit is ‘1’.
3.18.2.4
Offset
Bit offset and timeslot offset are both supported in all the operating
modes. The offset is between the framing pulse on the TSFS/MTSFS
pin and the start of the corresponding frame input on the TSD/MTSD
pin. The signaling bits on the TSIG/MTSIG pin are always per-timeslot
aligned with the data on the TSD/MTSD pin.
Refer to Chapter 3.18.1.4 Offset for the base line without offset in
different operating modes and the configuration of the offset.
In Non-multiplexed mode, the timeslot offset can be configured
from 0 to 31 timeslots (0 & 31 are included). In Multiplexed mode, the
timeslot offset can be configured from 0 to 127 timeslots (0 & 127 are
included).
Table 44: Related Bit / Register In Chapter 3.18
Bit
Register
Address (Hex)
TMUX
Backplane Global Configuration
010
MTSDA
TMODE
TBIF Operating Mode
043
MAP[1:0]
(T1/J1 only)
G56K
ID * - Channel Control (for T1/J1) /
Timeslot Control (for E1)
TPLC ID * - 01~18 (for
T1/J1) / 00~1F (for E1)
GAP
PCCE
TPLC Control Enable
0CC
FBITGAP
(T1/J1 only)
TBIF Option Register
042
FE
DE
FSTYP
FSINV
CMS
EDGE
TBIF Bit Offset
045
BOFF[2:0]
TCOFAI
RTSFS Change Indication
04B
TCOFAE
RTSFS Interrupt Control
04C
TSOFF[6:0]
TBIF TS Offset
044
Note:
*
ID means Indirect Register in the Transmit Payload Control function block.
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| VE-J12-MY-F2 | CONVERTER MOD DC/DC 15V 50W |
| LTC2498CUHF#PBF | IC ADC 24BIT 16CH 38-QFN |
| MS3102A24-3P | CONN RCPT 7POS BOX MNT W/PINS |
| VE-J11-MY-F4 | CONVERTER MOD DC/DC 12V 50W |
| EXP-0921/04/S | CONN RCPT 4POS IP68 W/SOCKETS |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| IDT82P2281PFG8 | 功能描述:TXRX SGL T1/E1/J1 80-TQFP RoHS:是 類別:集成電路 (IC) >> 接口 - 驅(qū)動(dòng)器，接收器，收發(fā)器 系列:- 標(biāo)準(zhǔn)包裝:250 系列:- 類型:收發(fā)器 驅(qū)動(dòng)器/接收器數(shù):2/2 規(guī)程:RS232 電源電壓:3 V ~ 5.5 V 安裝類型:表面貼裝 封裝/外殼:16-TSSOP（0.173"，4.40mm 寬） 供應(yīng)商設(shè)備封裝:16-TSSOP 包裝:帶卷 (TR) |
| IDT82P2281PFGBLANK | 制造商:IDT 制造商全稱:Integrated Device Technology 功能描述:Single T1/E1/J1 Long Haul / Short Haul Transceiver |
| IDT82P2281PN | 制造商:IDT 制造商全稱:Integrated Device Technology 功能描述:Single T1/E1/J1 Long Haul Short Haul Transceiver |
| IDT82P2282 | 制造商:IDT 制造商全稱:Integrated Device Technology 功能描述:Dual T1/E1/J1 Long Haul / Short Haul Transceiver |
| IDT82P2282_09 | 制造商:IDT 制造商全稱:Integrated Device Technology 功能描述:Dual T1/E1/J1 Long Haul / Short Haul Transceiver |
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