參數(shù)資料
型號(hào)： IDT74SSTV16857PAG
廠商： IDT, Integrated Device Technology Inc
文件頁(yè)數(shù)： 3/7頁(yè)
文件大?。?/td> 0K
描述： IC BUFFER 14BIT SSTL I/O 48TSSOP
標(biāo)準(zhǔn)包裝： 39
系列： 74SSTV
邏輯類型： 寄存緩沖器，帶 SSTL_2 輸入和輸出
電源電壓： 2.3 V ~ 2.7 V
位數(shù)： 14
工作溫度： 0°C ~ 70°C
安裝類型： 表面貼裝
封裝/外殼： 48-TFSOP（0.240"，6.10mm 寬）
供應(yīng)商設(shè)備封裝： 48-TSSOP
包裝： 管件
其它名稱： 74SSTV16857PAG
800-1698
800-1698-5
800-1698-ND
3
INDUSTRIALTEMPERATURERANGE
IDT74SSTV16857
14-BIT REGISTERED BUFFER WITH SSTL I/O
Symbol
Parameter
Test Conditions
Min.
Typ.
Max.
Unit
VIK
ControlInputs
VDD = 2.3V, II =
18mA
—
–1.2
V
VOH
VDD = 2.3V to 2.7V, IOH = -100
μAVDD – 0.2
—
V
VDD = 2.3V, IOH = -16mA
1.95
—
VOL
VDD = 2.3V to 2.7V, IOL = 100
μA
—
0.2
V
VDD = 2.3V, IOL = 16mA
—
0.35
II
AllInputs
VDD = 2.7V, VI = VDD or GND
—
±5
μA
IDD
StaticStandby
IO = 0, VDD = 2.7V, RESET = GND
—
0.01
mA
StaticOperating
IO = 0, VDD = 2.7V, RESET = VDD, VI = VIH (AC) or VIL (AC)
——
—
IDDD
Dynamic Operating (Clock Only)
IO = 0, VDD = 2.7V, RESET = VDD, VI = VIH (AC) or VIL (AC),—
—
μA/Clock
CLK and CLK Switching 50% Duty Cycle.
MHz
DynamicOperating
IO = 0, VDD = 2.7V, RESET = VDD, VI = VIH (AC) or VIL (AC),—
—
μA/Clock
(PerEachDataInput)
CLK and CLK Switching 50% Duty Cycle. One Data Input
MHz/Data
Switching at Half Clock Frequency, 50% Duty Cycle.
Input
rOH
Output HIGH
VDD = 2.3V to 2.7V, IOH = -20mA
7
—
20
Ω
rOL
OutputLOW
VDD = 2.3V to 2.7V, IOH = 20mA
7
—
20
Ω
rO(Δ)
| rOH- rOL| each separate bit
VDD = 2.5V, TA = 25°C, IOH = -20mA
—
4
Ω
DataInputs
VDD = 2.5V, VI = VREF
± 310mV
2.5
—
3.5
CI
CLK and CLK
VICR = 1.25V, VI (PP) = 360mV
2.5
—
3.5
pF
RESET
VI = VDD or GND
—
DCELECTRICALCHARACTERISTICSOVEROPERATINGRANGE(PC1600-PC2700)
FollowingConditionsApplyUnlessOtherwiseSpecified:
Operating Condition: TA = –40°C to +85°C, VDD = 2.5V ±0.2V, VDDQ = 2.5V ±0.2V
Symbol
Parameter
Test Conditions
Min.
Typ.
Max.
Unit
VIK
ControlInputs
VDD = 2.5V, II =
18mA
—
–1.2
V
VOH
VDD = 2.5V to 2.7V, IOH = -100
μAVDD – 0.2
—
V
VDD = 2.5V, IOH = -16mA
1.95
—
VOL
VDD = 2.5V to 2.7V, IOL = 100
μA
—
0.2
V
VDD = 2.5V, IOL = 16mA
—
0.35
II
AllInputs
VDD = 2.7V, VI = VDD or GND
—
±5
μA
IDD
StaticStandby
IO = 0, VDD = 2.7V, RESET = GND
—
0.01
mA
StaticOperating
IO = 0, VDD = 2.7V, RESET = VDD, VI = VIH (AC) or VIL (AC)
——
—
IDDD
Dynamic Operating (Clock Only)
IO = 0, VDD = 2.7V, RESET = VDD, VI = VIH (AC) or VIL (AC),—
—
μA/Clock
CLK and CLK Switching 50% Duty Cycle.
MHz
DynamicOperating
IO = 0, VDD = 2.7V, RESET = VDD, VI = VIH (AC) or VIL (AC),—
—
μA/Clock
(PerEachDataInput)
CLK and CLK Switching 50% Duty Cycle. One Data Input
MHz/Data
Switching at Half Clock Frequency, 50% Duty Cycle.
Input
rOH
Output HIGH
VDD = 2.5V to 2.7V, IOH = -20mA
7
—
20
Ω
rOL
OutputLOW
VDD = 2.5V to 2.7V, IOH = 20mA
7
—
20
Ω
rO(Δ)
| rOH- rOL| each separate bit
VDD = 2.6V, TA = 25°C, IOH = -20mA
—
4
Ω
DataInputs
VDD = 2.6V, VI = VREF
± 310mV
2.5
—
3.5
CI
CLK and CLK
VICR = 1.3V, VI (PP) = 360mV
2.5
—
3.5
pF
RESET
VI = VDD or GND
—
DC ELECTRICAL CHARACTERISTICS OVER OPERATING RANGE (PC3200)
FollowingConditionsApplyUnlessOtherwiseSpecified:
Operating Condition: TA = –40°C to +85°C, VDD = 2.6V ±0.1V, VDDQ = 2.6V ±0.1V
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PDF描述
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