ABSOLUTE MAXIMUM RATINGS " />
參數(shù)資料
型號(hào)： IDT74SSTU32865BKG8
廠商： IDT, Integrated Device Technology Inc
文件頁(yè)數(shù)： 14/15頁(yè)
文件大小： 0K
描述： IC BUFFER 28BIT 1:2 REG 160TFBGA
產(chǎn)品變化通告： Product Discontinuation 09/Dec/2011
標(biāo)準(zhǔn)包裝： 2,000
邏輯類(lèi)型： 1:2 寄存緩沖器，帶奇偶位
位數(shù)： 28
工作溫度： 0°C ~ 70°C
安裝類(lèi)型： 表面貼裝
封裝/外殼： 160-LFBGA
供應(yīng)商設(shè)備封裝： 160-CABGA（9x13）
包裝： 帶卷 (TR)
其它名稱(chēng)： 74SSTU32865BKG8
8
COMMERCIALTEMPERATURERANGE
IDT74SSTU32865
28-BIT 1:2 REGISTERED BUFFER WITH PARITY
ABSOLUTE MAXIMUM RATINGS (1)
Symbol
Description
Max.
Unit
VDD
SupplyVoltageRange
–0.5 to 2.5
V
VI(2,3)
InputVoltageRange
–0.5 to 2.5
V
VO(2,3)
OutputVoltageRange
–0.5 to VDD +0.5
V
IIK
InputClampCurrent
VI < 0
±50
mA
VI > VDD
IOK
OutputClampCurrent VO < 0
±50
mA
VO > VDD
IO
ContinuousOutputCurrent,
±50
mA
VO = 0 to VDD
VDD
ContinuousCurrentthrougheach
±100
mA
VDD or GND
TSTG
StorageTemperatureRange
–65to+150
°C
NOTES:
1. Stresses greater than those listed under ABSOLUTE MAXIMUM RATINGS may cause
permanent damage to the device. This is a stress rating only and functional operation
of the device at these or any other conditions above those indicated in the operational
sections of this specification is not implied. Exposure to absolute maximum rating
conditions for extended periods may affect reliability.
2. The input and output negative voltage ratings may be exceeded if the ratings of the
I/P and O/P clamp current are observed.
3. This value is limited to 2.5V maximum.
TIMING REQUIREMENTS OVER RECOMMENDED OPERATING FREE-AIR
TEMPERATURERANGE
VDD = 1.8V ± 0.1V
Symbol
Parameter
Min.
Max.
Unit
fCLOCK
Clock Frequency
—
270
MHz
tw
Pulse Duration, CLK, CLK HIGH or LOW
1
—
ns
tACT(1,2)
DifferentialInputsActiveTime
—
10
ns
tINACT(1,3)
DifferentialInputsInactiveTime
—
15
ns
tSU
SetupTime
DCSn before CLK
↑, CLK↓
0.7
—
ns
Data, PARIN, DODT, and DCKE before CLK
↑, CLK↓
0.5
—
tH
HoldTime
Data, DCSn, PARIN, DCKE, and DODT
0.5
—
ns
after CLK
↑, CLK↓
NOTES:
1. This parameter is not production tested.
2. Data and VREF inputs must be low a minimum time of tACT max, after RESET is taken HIGH.
3. Data, VREF, and clock inputs must be held at valid levels (not floating) a minimum time of tINACT max, after RESET is taken LOW.
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PDF描述
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IDT74SSTUBF32865ABK8 IC BUFFER 28BIT 1:2 REG 160-BGA
IDT74SSTUBF32866BBFG IC BUFFER 25BIT REG DDR2 96-BGA
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參數(shù)描述
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