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參數(shù)資料
| 型號(hào)： | IDT74FCT16952CTPAG |
| 廠商： | IDT, Integrated Device Technology Inc |
| 文件頁(yè)數(shù)： | 1/7頁(yè) |
| 文件大?。?/td> | 0K |
| 描述： | IC REGSTERD TRSCVR 16BIT 56TSSOP |
| 標(biāo)準(zhǔn)包裝： | 34 |
| 系列： | 74FCT |
| 邏輯類(lèi)型： | 寄存收發(fā)器，非反相 |
| 元件數(shù)： | 2 |
| 每個(gè)元件的位元數(shù)： | 8 |
| 輸出電流高，低： | 32mA，64mA |
| 電源電壓： | 4.5 V ~ 5.5 V |
| 工作溫度： | -40°C ~ 85°C |
| 安裝類(lèi)型： | 表面貼裝 |
| 封裝/外殼： | 56-TFSOP（0.240"，6.10mm 寬） |
| 供應(yīng)商設(shè)備封裝： | 56-TSSOP |
| 包裝： | 管件 |
| 其它名稱(chēng)： | 74FCT16952CTPAG |
1
IDT74FCT16925AT/CT/ET
FASTCMOS16-BITREGISTEREDTRANSCEIVER
INDUSTRIALTEMPERATURERANGE
FEATURES:
0.5 MICRON CMOS Technology
High-speed, low-power CMOS replacement for ABT functions
Typical tSK(o) (Output Skew) < 250ps
Low input and output leakage
≤≤≤≤≤1A (max.)
High drive outputs (-32mA IOH, 64mA IOL)
Power off disable outputs permit “l(fā)ive insertion”
Typical VOLP (Output Ground Bounce) < 1.0V at VCC = 5V,
TA = 25°C
Available in SSOP and TSSOP packages
FUNCTIONAL BLOCK DIAGRAM
The IDT logo is a registered trademark of Integrated Device Technology, Inc.
SEPTEMBER 2009
INDUSTRIAL TEMPERATURE RANGE
DSC-5442/5
IDT74FCT16952AT/CT/ET
FAST CMOS
16-BIT REGISTERED
TRANSCEIVER
DESCRIPTION:
The FCT16952T 16-bit registered transceiver is built using advanced
dual metal CMOS technology. These high-speed, low-power devices are
organized as two independent 8-bit D-type registered transceivers with
separate input and output control for independent control of data flow in either
direction. For example, the A-to-B Enable (x
CEAB) must be low to enter
data from the A port. xCLKAB controls the clocking function. When xCLKAB
toggles from low-to-high, the data present on the A port will be clocked into
the register. x
OEAB performs the output enable function on the B port. Data
flow from the B port to A port is similar but requires using x
CEBA, xCLKBA,
and x
OEBA inputs. Full 16-bit operation is achieved by tying the control pins
of the independent transceivers together.
The FCT16952T is ideally suited for driving high-capacitance loads and
low-impedance backplanes. The output buffers are designed with power off
disable capability allowing "live insertion" of boards when used as backplane
drivers.
2
OEAB
2
CEBA
2
CLKBA
2
OEBA
2
CEAB
2
CLKAB
2
A1
2
B1
TO SEVEN OTHER CHANNELS
D
C
D
C
CE
1
OEAB
1
CEBA
1
CLKBA
1
OEBA
1
CEAB
1
CLKAB
1
A1
1
B1
TO SEVEN OTHER CHANNELS
D
C
D
C
CE
54
55
1
3
2
56
5
52
31
30
28
26
27
29
15
42
2009 Integrated Device Technology, Inc.
相關(guān)PDF資料 |
PDF描述 |
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參數(shù)描述 |
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