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參數(shù)資料
| 型號(hào)： | IDT74ALVCF162835APV |
| 廠商： | INTEGRATED DEVICE TECHNOLOGY INC |
| 元件分類(lèi)： | 總線收發(fā)器 |
| 英文描述： | ALVC/VCX/A SERIES, 18-BIT DRIVER, TRUE OUTPUT, PDSO56 |
| 封裝： | 0.635 MM PITCH, SSOP-56 |
| 文件頁(yè)數(shù)： | 1/6頁(yè) |
| 文件大小： | 64K |
| 代理商： | IDT74ALVCF162835APV |
INDUSTRIALTEMPERATURERANGE
IDT74ALVCF162835A
3.3V CMOS 18-BIT UNIVERSAL BUS DRIVER WITH 3-STATE OUTPUTS
1
MAY 1999
INDUSTRIAL TEMPERATURE RANGE
The IDT logo is a registered trademark of Integrated Device Technology, Inc.
1999 Integrated Device Technology, Inc.
DSC-4920/1
FEATURES:
0.5 MICRON CMOS Technology
Typical tSK(o) (Output Skew) < 250ps
ESD > 2000V per MIL-STD-883, Method 3015; > 200V using
machine model (C = 200pF, R = 0)
VCC = 3.3V ± 0.3V, Normal Range
VCC = 2.7V to 3.6V, Extended Range
VCC = 2.5V ± 0.2V
CMOS power levels (0.4
W typ. static)
Rail-to-Rail output swing for increased noise margin
Available in SSOP, TSSOP, and TVSOP packages
FUNCTIONAL BLOCK DIAGRAM
DRIVE FEATURES:
Balanced Output Drivers: ±18mA
Low switching noise
APPLICATIONS:
SDRAM Modules
PC Motherboards
Workstations
IDT74ALVCF162835A
3.3V CMOS 18-BIT
UNIVERSAL BUS DRIVER
WITH 3-STATE OUTPUTS
DESCRIPTION:
This 18-bit universal bus driver is built using advanced dual metal CMOS
technology. Data flow from A to Y is controlled by the output-enable (OE)
input. The device operates in the transparent mode when the latch-enable
(LE) input is high. The A data is latched if the clock (CLK) input is held at
a high or low logic level. If LE is low, the A data is stored in the latch flip-flop
on the low-to-high transition of CLK. When OE is high, the outputs are in the
high-impedance state.
The ALVCF162835A has series resistors in the device output structure
which will reduce switching noise in 128MB and 256MB SDRAM modules.
Designed with a drive capability of ±18mA, the ALVCF162835A is a mid-
way drive between the ALVC162835 (±12mA) and ALVC16835 (±24mA).
The ALVCF162835A is a faster version of the ALVCF162835 or
ALVC162835. It is suitable for PC133 applications and particularly SDRAM
Modules clocked at 133 MHz.
LE
A1
TO 17 OTHER CHANNELS
OE
CLK
27
54
28
30
1
D
CLK
3
Y1
C1
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