IDT72V3622/72V3632/72V3642 CMOS 3.3V SyncBiFIFOTM 256 x 36 x 2, 512 x 36" />
參數(shù)資料
型號： IDT72V3642L10PF
廠商： IDT, Integrated Device Technology Inc
文件頁數(shù)： 9/29頁
文件大小： 0K
描述： IC FIFO SYNC 3.3V CMOS 120-TQFP
標(biāo)準(zhǔn)包裝： 45
系列： 72V
功能： 同步
存儲容量： 72k（1k x 36 x 2）
數(shù)據(jù)速率： 100MHz
訪問時間： 10ns
電源電壓： 3 V ~ 3.6 V
工作溫度： 0°C ~ 70°C
安裝類型： 表面貼裝
封裝/外殼： 120-LQFP
供應(yīng)商設(shè)備封裝： 120-TQFP（14x14）
包裝： 托盤
其它名稱： 72V3642L10PF
800-1534
17
COMMERCIAL TEMPERATURERANGE
IDT72V3622/72V3632/72V3642 CMOS 3.3V SyncBiFIFOTM
256 x 36 x 2, 512 x 36 x 2, 1,024 x 36 x 2
NOTE:
1. tSKEW1 is the minimum time between a rising CLKA edge and a rising CLKB edge for ORB to transition HIGH and to clock the next word to the FIFO1 output register in three CLKB cycles.
If the time between the rising CLKA edge and rising CLKB edge is less than tSKEW1, then the transition of ORB HIGH and load of the first word to the output register may occur one CLKB
cycle later than shown.
Figure 8. ORB Flag Timing and First Data Word Fall Through when FIFO1 is Empty (FWFT Mode)
CSA
W
RA
MBA
IRA
A0 - A35
CLKB
ORB
CSB
W/RB
MBB
ENA
ENB
B0- B35
CLKA
4660 drw 10
12
3
tCLKH
tCLKL
tCLK
tENS2
tENH
tDS
tDH
tSKEW1
tCLK
tCLKL
tREF
tENS2
tENH
tA
Old Data in FIFO1 Output Register
W1
FIFO1Empty
LOW
HIGH
LOW
HIGH
LOW
tCLKH
W1
HIGH
(1)
相關(guān)PDF資料
PDF描述
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